[发明专利]半导体装置及其制造方法、以及吸附位阻断原子层沉积法无效

专利信息
申请号: 201110296815.5 申请日: 2011-09-27
公开(公告)号: CN102446890A 公开(公告)日: 2012-05-09
发明(设计)人: 广田俊幸;清村贵利;两角友一朗;菱屋晋吾 申请(专利权)人: 尔必达存储器株式会社;东京毅力科创株式会社
主分类号: H01L23/522 分类号: H01L23/522;H01L21/02;H01L21/314;H01L21/316;H01L21/8242
代理公司: 中原信达知识产权代理有限责任公司 11219 代理人: 谢丽娜;关兆辉
地址: 日本*** 国省代码: 日本;JP
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摘要:
搜索关键词: 半导体 装置 及其 制造 方法 以及 吸附 阻断 原子 沉积
【说明书】:

技术领域

发明涉及半导体装置及其制造方法,详细而言,涉及具有电容器的半导体装置、特别是用于电容器的电介质膜及其制造方法。另外,本发明涉及适合杂质的低浓度导入的新的原子层沉积法(ALD法)。 

背景技术

目前,所使用的DRAM用电容器的电介质材料之一有氧化锆(ZrO2)。 

DRAM在形成电容器后作为不可避免的工序存在450℃~500℃左右的热处理,此时,氧化锆膜单体的电介质膜不能得到充分的热稳定性,在热处理后产生漏泄电流增大等的问题。 

因此,进行了赋予热稳定性的各种尝试,有具有将ZAZ构造(TiN/ZrO2/Al2O3/ZrO2/TiN、ZAZ的Z是指ZrO2层,A是指Al2O3层。)、及Al2O3和ZrO2的膜层叠多层的构造的材料等。 

这些构造通过将介电常数高的氧化锆(ZrO2)、介电常数不高而热稳定性优异的氧化铝(Al2O3),得到所希望的特性。 

例如JP 2006-135339A中公开有,用于特征尺寸(F值:最小图案间距的1/2)为70nm以下的DRAM,将AZ构造、ZA构造、ZAZ构造、或ZrO2薄膜和Al2O3薄膜交互层叠而成的多重介电膜的形成方法。 

该薄膜形成使用ALD法,Zr源公开有ZrCl4、Zr[N(CH3)C2H5]4、Zr(O-tBu)4、Zr[N(CH3)2]4、Zr[N(C2H5)(CH3)]4、Zr[N(C2H5)2]4、Zr(tmhd)4、 Zr(OiC3H7)3(tmtd)及Zr(OtBu)4,另外,Al源公开有Al(CH3)3、Al(C2H5)3。 

在得到ZrO2薄膜的ALD法中,重复所希望的次数的下述步骤:使Zr源吸附于基板表面后,利用N2、Ar等净化气体将未吸附的Zr源从反应室排出,通过O3等反应气体使其氧化,利用与上述相同的净化气体净化未反应的反应气体。 

另外,要得到Al2O3薄膜,同样重复所希望次数的下述步骤:使Al源吸附于基板表面后,利用N2、Ar等净化气体将未吸附的Al源从反应室排出,通过O3等反应气体使其氧化,净化未反应的反应气体。 

另外,JP 2007-73926A中公开有:“一种介质膜,其特征在于,具备:至少具有25的相对介电常数的第一介质膜、使用结晶化率比该第一介质膜低的物质形成于上述第一介质膜上的第二介质膜、使用与上述第一介质膜相同的物质形成于上述第二介质膜上的第三介质膜”,表示在结晶化的ZrO2之间非晶质的Al2O3所存在的构造与其相对应。 

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