[发明专利]用于处理显示端口配置数据的透明转发器设备无效

专利信息
申请号: 201110287197.8 申请日: 2011-09-23
公开(公告)号: CN102436799A 公开(公告)日: 2012-05-02
发明(设计)人: 肯尼斯·哈拉米诺 申请(专利权)人: NXP股份有限公司
主分类号: G09G5/00 分类号: G09G5/00;H04N5/765
代理公司: 中科专利商标代理有限责任公司 11021 代理人: 王波波
地址: 荷兰艾*** 国省代码: 荷兰;NL
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摘要:
搜索关键词: 用于 处理 显示 端口 配置 数据 透明 转发器 设备
【权利要求书】:

1.一种显示端口转发器电路,包括:

上游数据接口;

下游数据接口;

多个显示端口配置数据DPCD寄存器,以及

控制电路,与所述上游数据接口、下游数据接口和多个DPCD寄存器相连,所述控制电路配置为:

通过访问所述多个DPCD寄存器的一个或多个,对从所述上游数据接口接收到的、在DPCD访问事务的第一列表中所包括的DPCD访问事务进行处理;以及

通过提供透明通信路径以将所述事务转发至下游数据接口,对从所述上游数据接口接收到的、在DPCD访问事务的第二列表中所包括的DPCD访问事务进行处理。

2.根据权利要求1所述的显示端口转发器电路,其中所述控制电路还配置为:

对上游数据接口上的一个或多个通信链路以及下游数据接口上的一个或多个通信链路进行训练;

在对上游和下游数据接口上的通信链路进行训练时,通过访问所述多个DPCD寄存器的一个或多个,对从上游数据接口接收到的、在链路训练事务的列表中所包括的DPCD访问事务进行处理;以及

在对上游和下游数据接口上的通信链路进行训练之后,通过将DPCD访问事务转发至下游数据接口,对从上游数据接口接收到的、在链路训练事务的列表中所包括的DPCD访问事务进行处理。

3.根据权利要求2所述的显示端口转发器电路,其中:

对上游和下游数据接口上的通信链路进行训练将通信链路设置为第一链路速率;以及

所述控制电路还配置为响应于对上游或下游数据接口上的一个或多个通信链路进行训练的失败,重新训练上游和下游数据接口上的通信链路,以将所述通信链路设置为小于第一速率的第二速率。

4.根据权利要求1所述的显示端口转发器电路,其中所述控制电路还配置为提供与上游数据接口相连的上游设备和与下游数据接口相连的下游设备之间的透明通信路径,用于在DPCD访问事务的第二列表中所包括的一个或多个DPCD访问事务。

5.根据权利要求1所述的显示端口转发器电路,其中所述DPCD访问事务的第二列表包括保留的DPCD访问事务。

6.根据权利要求1所述的显示端口转发器电路,其中所述控制电路还配置为响应于接收对于所述转发器不支持的DPCD寄存器的DPCD访问事务,提供透明通信路径以将所述DPCD访问事务转发至下游数据接口。

7.根据权利要求6所述的显示端口转发器电路,其中将对称的链路配置为具有相同的链路速率。

8.根据权利要求2所述的显示端口转发器电路,其中在DPCD访问事务的第一列表中包括一个或多个DPCD访问事务,以及在DPCD访问事务的第二列表中包括一个或多个DPCD访问事务。

9.根据权利要求2所述的显示端口转发器电路,其中对上游数据接口上的一个或多个通信链路以及下游数据接口上的一个或多个通信链路进行训练,对上游和下游数据接口上的一个或多个链路进行配置,以符合由转发器电路和下游设备两者所支持的显示端口链路配置。

10.根据权利要求9所述的显示端口转发器电路,其中对上游数据接口上的一个或多个通信链路以及下游数据接口上的一个或多个通信链路进行训练,包括:

确定所述显示端口转发器电路的DPCD寄存器空间修正级别、链路速率、通路计数、最大向下传播、训练Aux Rd间隔和快速AUX能力;以及

确定所述下游设备的DPCD寄存器空间修正级别、链路速率、通路计数、最大向下传播、训练Aux Rd间隔和快速AUX能力。

11.根据权利要求1所述的显示端口转发器电路,其中所述DPCD访问事务的第二列表包括保留用于消息的DPCD寄存器的显示端口本地Aux事务。

12.根据权利要求1所述的显示端口转发器电路,其中DPCD访问事务的第二列表包括保留用于有效载荷带宽分配相关事务的DPCD寄存器的事务以及保留用于消息的DPCD寄存器的事务。

13.根据权利要求1所述的显示端口转发器电路,其中DPCD访问事务的第二列表包括保留用于功率管理相关事务的DPCD寄存器的事务以及保留用于消息的DPCD寄存器的事务。

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