[发明专利]显示装置及具有显示装置的电子设备无效
申请号: | 201110266542.X | 申请日: | 2011-09-09 |
公开(公告)号: | CN102456314A | 公开(公告)日: | 2012-05-16 |
发明(设计)人: | 吉贺正博 | 申请(专利权)人: | 群康科技(深圳)有限公司;奇美电子股份有限公司 |
主分类号: | G09G3/20 | 分类号: | G09G3/20;G09G3/36 |
代理公司: | 北京市柳沈律师事务所 11105 | 代理人: | 史新宏 |
地址: | 518109 广东省深圳市*** | 国省代码: | 广东;44 |
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摘要: | |||
搜索关键词: | 显示装置 具有 电子设备 | ||
技术领域
本发明是有关于具有配置成行列矩阵型式的多个像素和配置于像数列或像素行的多个信号线的显示装置以及具有该显示装置的电子设备。
背景技术
在具有配置成行列矩阵型式的多个像素的显示装置中,每个像素包括配置于信号线(又称源极线)与扫描线(又称栅极线)交叉处的开关元件。每个像素还包括形成于与开关元件相同的基板上的像素电极以及形成于像素电极对面的基板上的公共电极。公共电极耦接至所有像素共享的定电压源。开关元件根据该开关元件所属像素行所对应连接的栅极线上的扫描信号而导通。开关元件导通的期间即一般所称的「扫描期间」。在扫描期间中,像素电极经由开关元件耦接至该像素电极所属像素列所对应连接的源极线,并于该像素电极施加信号电压。像素电极和公共电极之间因此产生电位差,而此电位差驱动配置在像素电极和公共电极之间的显示元件。举例而言,当显示元件为液晶时,液晶分子的排列方向会随着像素电极和公共电极之间的电位差而改变,透射或被反射的光量也跟着改变,因此显示元件能进行显示。
一般而言,开关元件是使用薄膜晶体管(TFT)构成。但是,当使用薄膜晶体管时,光照射下所造成的漏电流便成为问题。当光照射在薄膜晶体管时,尽管薄膜晶体管为关闭,储存在液晶显示元件以及与液晶显示元件并联配置的储存电容器内的电荷仍经由薄膜晶体管漏出至信号线,因而造成串扰(crosstalk)。
有鉴于此,欲抑制漏出至信号线的光漏电流的发明将被参考,例如日本专利第2005-338285号公报(专利文献1)以及日本专利第2003-215536号公报(专利文献2)。
[专利文献1]日本专利第2005-338285号公报
[专利文献2]日本专利第2003-215536号公报
发明内容
[发明所欲解决的问题]
尽管如此,现有技术对于完全抑制漏出至信号线的光电流仍有困难,即使能够完全抑制漏出至信号线的光电流,还是有电路结构和控制因此变得复杂的问题存在。
本发明有鉴于现有技术所面临的问题,目的在于提供一种显示装置及具有该显示装置的电子设备以在不使电路结构和控制复杂化的情况下抑制光漏电流。
[解决问题的方法]
为了达到上述目的,本发明提供一种显示装置,其包括:多个像素,其配置为行列矩阵型式;以及多个信号线,其配置于该多个像素的像素行或像素列;其中每个像素包括:像素电极;第一和第二开关元件,其串联配置于与该像素的行或列对应连接的信号线以及该像素电极之间,并同步导通和关闭;以及阻抗元件,其从该第一和该第二开关元件中间耦接至一预设的定电压;其中该阻抗元件的阻抗值比该第一和该第二开关元件的导通阻抗大且比该第一和该第二开关元件的关闭阻抗小;其中该预设的定电压等于输入至该信号线的信号电压的中心电压。
根据于此,本发明提供一种显示装置以在不使电路结构和控制复杂化的情况下抑制光漏电流。
在一实施型态中,该预设的定电压配置于该像素电极经由显示元件的对向侧,并为全部像素所共享的公共电极的电压。该显示元件例如为液晶。
在一实施型态中,该阻抗元件例如为电阻器,包括第一端和第二端,该第一端耦接于该第一和该第二开关元件之间,而该第二端耦接于该公共电极。
在一实施型态中,该阻抗元件为在该第一和该第二开关元件导通的期间关闭且在该第一和该第二开关元件关闭的期间导通的第三开关元件。在一例子中,该第一和该第二开关元件为N型薄膜晶体管,该第三开关元件为P型薄膜晶体管。在另一例子中,该第一和该第二开关元件为P型薄膜晶体管,该第三开关元件为N型薄膜晶体管。
遵从本发明实施型态的显示装置可为例如电视接收机、笔记本型个人计算机(PC)、移动电话、手表、个人数字助理(PDA)、汽车导航装置、可携式游戏机或Aurora Vision等,而具有该等显示装置的电子设备可向使用者提供图像。
[发明的效果]
根据本发明的实施型态,本发明提供一种显示装置及具有该显示装置的电子设备以在不使电路结构和控制复杂化的情况下抑制光漏电流。
附图说明
图1所示为根据本发明实施形态的显示装置的结构方块图;
图2所示为先前技术中一般像素结构的电路图;
图3所示为根据本发明实施形态的像素结构的电路图;
图4所示为图3的像素结构的变异例的电路图;
图5所示为发生在具有如图4所示的像素电路的显示装置中的串扰量以及遵从先前技术的显示装置中的串扰量的比较示意图;
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