[发明专利]一种由软件方式生成动态可重构处理器配置信息的系统有效

专利信息
申请号: 201110201224.5 申请日: 2011-07-18
公开(公告)号: CN102393814A 公开(公告)日: 2012-03-28
发明(设计)人: 刘雷波;王延升;朱敏;邹于佳;杨军;曹鹏;时龙兴;尹首一;魏少军 申请(专利权)人: 清华大学
主分类号: G06F9/34 分类号: G06F9/34;G06F9/38
代理公司: 北京润泽恒知识产权代理有限公司 11319 代理人: 苏培华
地址: 100084*** 国省代码: 北京;11
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摘要:
搜索关键词: 一种 软件 方式 生成 动态 可重构 处理器 配置 信息 系统
【说明书】:

技术领域

发明涉及嵌入式系统领域中的动态可重构处理器技术领域,特别是涉及一种由软件方式生成动态可重构处理器配置信息的系统。

背景技术

动态可重构处理器是一种新生的处理器构架,其较之以往的单核处理器、专用芯片、现场可编程逻辑阵列有着显著的优势,是未来电路结构发展的一个方向。

首先,动态可重构处理器内往往含有多个算数逻辑单元,且数量巨大,称之为众核阵列。阵列内部配以灵活度高的路由单元,实现算数逻辑单元之间多样化的互联。因此,经路由单元连接后的众核阵列可实现对数据流的高速处理,较传统的单核以及少核处理器在性能上有着巨大的优势。同时,较固化的专用电路在灵活性上也有着巨大的优势。

其次,较传统的静态可重构电路---现场可编程逻辑阵列而言,动态可重构处理器有动态的特点,即在电路运行过程中可动态的切换电路的功能,而非以往静态可重构电路一沉不变的不改变电路功能,只是在电路运行之前烧写电路功能,对电路进行初始化。这样做的好处在于通过时分复用的方式减少了电路的规模,原因在于之前的电路结构的全映射现在变为分块映射,而块与块之间恰好采取了动态切换的方式。

目前的实际应用中往往需要生成配置信息,而现有技术通常不能满足实际应用的需求,因此,需要本领域技术人员迫切解决的一个技术问题就是:如何能够创新的提出有一种有效措施以克服现有技术存在的缺陷,实现用软件方式生成动态可重构处理器的配置信息,从而实现动态可重构处理器的功能。

发明内容

本发明所要解决的技术问题是提供一种由软件方式生成动态可重构处理器配置信息的系统,有效的实现用软件方式生成动态可重构处理器的配置信息,实现了动态可重构处理器的功能。

为了解决上述问题,本发明公开了一种由软件方式生成动态可重构处理器配置信息的系统,包括:

主处理器、配置信息生成处理器、动态可重构处理器和系统总线,其中,主处理器,用于负责运行应用的控制部分,通过系统总线向配置信息生成处理器发送配置信息生成所需参数,并通过向配置信息生成处理器传递参数,间接实现对动态可重构处理器的控制;

配置信息生成处理器,接收由主处理器发送过来的生成配置信息所需参数,并处理生成动态可重构处理器的配置信息,通过系统总线将生成的动态可重构处理器的配置信息发送到动态可重构处理器中,并通过向动态可重构处理器发送配置信息,直接实现对动态可重构处理器的控制;

动态可重构处理器,接收从配置信息生成处理器传送过来的配置信息,并根据配置信息配置为所需状态;

系统总线,负责整个系统中处理器间数据传输,包括主处理器通过系统总线向配置信息生成处理器传输数据,配置信息生成处理器通过系统总线向动态可重构处理器传输数据。

优选的,动态可重构处理器的N个任务对应在软件构架中N个分支,软件在配置信息生成处理器上运行。

优选的,动态可重构处理器的所有任务都编写为对应的软件代码。

优选的,配置信息生成处理器根据由主处理器传递来的参数判断出可重构处理器将要执行哪一个任务,即将主处理器传递来的参数作为分支判断的输入,选择出某一个分支。

与现有技术相比,本发明具有以下优点:

本发明提供一种由软件方式生成动态可重构处理器配置信息的系统,包括主处理器、配置信息生成处理器、动态可重构处理器和系统总线,各部分协调工作从而实现生成动态可重构处理器的配置信息,实现了在动态可重构处理器进行应用处理的功能。

附图说明

图1是本发明具体实施方式中所述的一种典型的动态可重构处理器的示意图;

图2是本发明具体实施方式中所述的一种由软件方式生成动态可重构处理器配置信息的系统的结构示意图;

图3是本发明具体实施方式中所述的一种在上述由软件方式生成动态可重构处理器配置信息的系统的流程示意图。

具体实施方式

为使本发明的上述目的、特征和优点能够更加明显易懂,下面结合附图和具体实施方式对本发明作进一步详细的说明。

一种典型的动态可重构处理器的结构示意图如图1所示,动态可重构处理器的运转流程可概括为如下步骤:

1.动态可重构处理器由外部数据读入装置将处理器外存储器内待处理的数据读入处理器内,分发至多个子单元处理内的外部数据缓存器。

2.多个子单元将数据从各自的外部数据缓存器读出,再进行处理。多个子单元同时处理,以达并行处理的效果。各子单元处理完后,将结果数据存于各自的内部数据缓存器。

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