[发明专利]视频图像处理系统延时检测方法无效
申请号: | 201110087500.X | 申请日: | 2011-04-08 |
公开(公告)号: | CN102158728A | 公开(公告)日: | 2011-08-17 |
发明(设计)人: | 金伟其;范永杰;骆媛;李家坤 | 申请(专利权)人: | 北京理工大学 |
主分类号: | H04N17/00 | 分类号: | H04N17/00 |
代理公司: | 暂无信息 | 代理人: | 暂无信息 |
地址: | 100081 *** | 国省代码: | 北京;11 |
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摘要: | |||
搜索关键词: | 视频 图像 处理 系统 延时 检测 方法 | ||
技术领域
本发明涉及一种延时检测方法,特别涉及一种针对视频图像处理系统的延时方法,属于视频图像处理领域。
背景技术
各种传感器(如可见光、长波红外、中波红外、近红外等)探测技术得到了迅速发展,于是针对各种传感器应用的视频图像处理系统应运而生。视频图像处理系统在进行视频处理时总是会对视频信号流产生延时,而系统的延时在一些实时性要求较为严格的应用环境下是一个极为重要的参数。如应用于车辆驾驶观察系统,当发现前方有障碍物时,若系统延时较大,会严重降低驾驶员避让的反应速度,在高速行驶时极有可能造成恶劣后果。因此,能够精确掌握图像处理系统的延时量,对于更上一级的系统设计或确定系统应用环境,是有着现实意义的。但是在现有技术中未找到一种能够精确测试系统延时的方法。
发明内容
本发明的目的是针对现有技术的缺点,实现一种简单、实用并能够精确测定视频图像处理系统延时的方法。
本发明提供了一种视频图像处理系统延时检测方法,包括以下步骤:
步骤一、利用PC机编辑所需的测试图像,将测试图像送入测试视频发生器,测试视频发生器将测试图像存于flash中备用;
步骤二、在测试时通过上位机控制选择测试图像,以及测试视频的具体序列形式和视频格式;
本发明将被测系统视为黑盒,只需了解被测系统输入输出视频标准即可,如PAL,NTSC,VGA等以及各种数字视频,按照被测系统视频标准输入测试视频。
优选的,测试视频中的测试图像是连续、间隔输出的,如:测试图像连续发送n帧,之后视频输出单一灰度电平m帧,以此序列周期重复发送;其中n、m为任意整数。因为如果图像为无变化或者变化较小的无间隔连续输出,则从示波器上观察是很难分辨出相对应的输入帧与输出帧,导致很难测试系统延时。按照该优选方法生成的测试视频序列,相当于不断的周期性地重复视频的起始状态,于是可以非常方便的找到输入输出图像序列帧的对应关系。
步骤三、将测试视频送入被测系统;
步骤四、将步骤二产生的测试视频与被测系统输出视频送入示波器或逻辑分析仪,读取输入输出的时间差,即为系统延时量。示波器对应测量模拟视频,逻辑分析仪对应测量数字视频。
本发明提供了一种简单、直观、实用的方法,可以精确的检测视频图像处理系统的延时。
附图说明
图1为本发明所述方法的原理图。
图2为测试视频发生器原理框图。
图3为利用示波器读取延时量示意图。
具体实施方式
下面结合附图,具体说明本发明的优选实施方式。
以PAL制视频处理系统为例,对本发明作进一步说明。
如图2,测试视频发生器,以FPGA 2为核心器件,配以flash 6,SRAM 7以及视频DA 8。当前具体使用型号为XC5VLX50T-FF11362。flash 6型号K9F4G08UOA,容量4Gbit,最小读写周期可达25ns,数据宽度8bit。PAL制DA8选择SAA7121H,可将CCIR656数字视频转换为PAL模拟视频。其参数可通过I2C总线,进行配置。同步SRAM 7型号为IDT71V65803可替代型号为GS880z183236b,该型SRAM的读写速度可达到150MHz,数据宽度16bit。
测试前由上位机(PC机)1,编辑测试图像,通过UART串口发送至测试视频发生器。测试视频发生器的FPGA中的MicroBlaze 3实现与上位机1的通信。MicroBlaze是Xilinx公司推出的可以嵌入在FPGA中的RISC 32位软处理器软核,具有运行速度快、占用资源少、可配置性强等优点。支持CoreConnect总线的标准外设集合。对应本发明应用该软核可以方便利用I2C接口实现SAA71218芯片的配置,利用UART接口实现与上位机1的通信,利用GPIO接口实现FPGA内部模块的数据传输以及操控。
当MicroBlaze 3接收到测试图像后将图像数据传输给存储器控制模块5,同时发出控制命令,将测试图像数据存储于flash 6中。
通过上位机1发送命令,选择测试使用的图像,并将图像从flash 6中调入SRAM 7中。另外通过上位机1发送命令,给SAA7121驱动4,对视频序列的组成进行配置。
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