[发明专利]存储器装置有效
| 申请号： | 201110045395.3 | 申请日： | 2011-02-22 |
| 公开（公告）号： | CN102194508A | 公开（公告）日： | 2011-09-21 |
| 发明（设计）人： | 赖俊树;吉川定男 | 申请（专利权）人： | 安森美半导体贸易公司 |
| 主分类号： | G11C7/06 | 分类号： | G11C7/06 |
| 代理公司： | 中科专利商标代理有限责任公司 11021 | 代理人： | 李贵亮 |
| 地址： | 百慕大群*** | 国省代码： | 百慕大群岛;BM |
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| 摘要： | |||
| 搜索关键词： | 存储器 装置 | ||
1.一种存储器装置，其特征在于，包括：
存储器单元阵列，其存储数据；
地址译码器，其根据与时钟同步地串行输入的地址信号，选择所述存储器单元阵列的地址；
多个读出电路，与所述数据的各位对应地一个一个设置；以及
移位寄存器，其与所述时钟同步地，从顶端位起依次串行输出从所述多个读出电路读出的数据，
所述地址译码器通过在确定所述地址信号的全部位之前，将顶端位的多个候补数据分别输入到该候补数据的个数量的读出电路，从而开始多个候补数据的读出。
2.根据权利要求1所述的存储器装置，其特征在于，
所述多个读出电路包括第一和第二读出电路，
所述地址译码器在除了最后一位之外确定了所述地址信号时，根据该地址信号选择顶端位的第一和第二候补数据，将第一候补数据输入到所述第一读出电路，将第二候补数据输入到所述第二读出电路。
3.根据权利要求2所述的存储器装置，其特征在于，
所述地址译码器在确定了所述地址信号的全部位，并根据该地址信号将所述第一候补数据选择为最终数据时，将所述第一候补数据继续输入到所述第一读出电路，将所述顶端位的下一个位的数据输入到所述第二读出电路。
4.根据权利要求1所述的存储器装置，其特征在于，
所述地址译码器在除了最后两个位之外确定了所述地址信号时，将顶端位的四个候补数据分别输入到四个读出电路。
5.一种存储器装置，其特征在于，包括：
存储器单元阵列，其存储N位数据宽度的数据；
地址译码器，其根据与时钟同步地串行输入的M位的地址信号，选择所述存储器单元阵列的地址；
N个读出电路，与所述数据的各位对应地设置；以及
移位寄存器，其与所述时钟同步地，从顶端位起依次串行输出从所述N个读出电路读出的数据，
在所述地址信号中确定了(M-X)位的地址信号时，所述地址译码器根据该(M-X)位的地址信号，按所述N位的每个位选择2X个候补数据，将与顶端位对应的2X个候补数据分别输入到所述N个读出电路中的2X个读出电路，从而开始2X个候补数据的读出。
6.根据权利要求5所述的存储器装置，其特征在于，
在确定了所述地址信号的全部位时，所述地址译码器根据该确定的地址信号，从2X个候补数据中将一个候补数据选择为最终数据，并将选择的一个候补数据继续输入到一个读出电路，将剩余的(N-1)位的数据分别输入到剩余的(N-1)个读出电路。
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