[实用新型]一种视频和多路RS-232高速并传电路无效
| 申请号： | 201020688866.3 | 申请日： | 2010-12-29 |
| 公开（公告）号： | CN201995071U | 公开（公告）日： | 2011-09-28 |
| 发明（设计）人： | 魏洵佳 | 申请（专利权）人： | 康佳集团股份有限公司 |
| 主分类号： | H04N7/18 | 分类号： | H04N7/18;H04N5/268 |
| 代理公司： | 深圳市兴科达知识产权代理有限公司 44260 | 代理人： | 王翀 |
| 地址： | 518000 广东省深*** | 国省代码： | 广东;44 |
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| 摘要： | |||
| 搜索关键词： | 一种 视频 rs 232 高速 电路 | ||
1.一种视频和多路RS-232高速并传电路，其特征在于，包括：多个RS-485下位机、差分转换模块、多路RS-232基频采样模块、并串编码模块、数据有效发生器、视频输入解码模块、视频数据转换模块、数据混合模块、数据高频通讯发送模块、数据高频通讯接收模块、数据基频解码模块、多路RS-232解码模块、上位机、视频数据编码模块和监视器；
多个RS-485下位机的输出端分别通过差分转换模块与多路RS-232基频采样模块的输入端连接，多路RS-232基频采样模块的输出端分别通过并串编码模块、数据有效发生器与数据混合模块的输入端连接；视频输入解码模块的输出端经过视频数据转换模块与数据混合模块的输入端连接，数据混合模块的输出端与数据高频通讯发送模块连接；数据高频通讯接收模块的输出端经过数据基频解码模块分别与视频数据编码模块的输入端和多路RS-232解码模块的输入端连接，视频数据编码模块的输出端与监视器连接，多路RS-232解码模块的输出端与上位机连接。
2.根据权利要求1所述的视频和多路RS-232高速并传电路，其特征在于：所述多路RS-232基频采样模块、并串编码模块、数据有效发生器、视频数据转换模块、数据混合模块由远端控制器中的FPGA实现。
3.根据权利要求1或2所述的视频和多路RS-232高速并传电路，其特征在于：所述数据基频解码模块和多路RS-232解码模块由近端主控器中的FPGA实现。
4.根据权利要求1或2所述的视频和多路RS-232高速并传电路，其特征在于：所述数据高频通讯发送模块和数据高频通讯接收模块通过光纤或网线连接。
5.根据权利要求3所述的视频和多路RS-232高速并传电路，其特征在于：所述数据高频通讯发送模块和数据高频通讯接收模块通过光纤或网线连接。
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