[发明专利]TDM总线扩展方法无效

专利信息
申请号: 201010617939.4 申请日: 2010-12-31
公开(公告)号: CN102567267A 公开(公告)日: 2012-07-11
发明(设计)人: 丛远建;侯玉成;江霞 申请(专利权)人: 北京大唐高鸿数据网络技术有限公司
主分类号: G06F13/40 分类号: G06F13/40
代理公司: 北京北新智诚知识产权代理有限公司 11100 代理人: 赵郁军
地址: 100191*** 国省代码: 北京;11
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摘要:
搜索关键词: tdm 总线 扩展 方法
【说明书】:

技术领域

发明涉及一种TDM总线扩展方法,属于通信领域。

背景技术

TDM总线(TDM_BUS)是一种串行总线标准,广泛使用在多种通信系统中,它利用时分复用(TDM)原理在其上传送多路串行语音信号。例如,在交换设备中,TDM总线用于传送时钟、帧同步、接收数据和发送数据四个信号。

如图1,一个典型的通信系统一般包括若干个媒体对象13,这些媒体对象13自身带有TDM接口而直接挂接在TDM总线12(TDM_BUS)上,这些媒体对象13与媒体处理器11之间通过TDM总线12传送和交换信息。媒体对象13可为带有TDM接口的媒体芯片、媒体模块或媒体电路板。例如,业内专用ASIC语音处理芯片、语音编解码DSP、PSTN中使用的CODEC芯片以及E1芯片等,它们一般都带有物理TDM接口。

目前,TDM总线因其自身的通信优势,越来越广泛地应用在各类通信系统中,但是,随着电子通信技术的发展,TDM总线上的负载数量逐渐增多(即器件数量增加),而这种负载效应不仅表现在数据总线上接入管脚数量的增多,也表现在对PCB走线和连接器所引起的电容负载效应的影响,使得TDM总线负载与媒体对象13驱动能力之间产生矛盾。而对于大容量高速通信系统来说,这种TDM总线负载与媒体对象13驱动能力之间的矛盾就更为明显。

为了解决上述问题,目前出现了三种解决方法,但它们自身都有局限性。

第一种方法是降低TDM总线的工作时钟频率。虽然这种方法在一定程度上能放宽挂接的媒体对象13的数量,但是,此方法会直接限制通信系统对语音数据流的处理、交换和传送的速度。对于高速通信系统来说,这种方法更不可取。

第二种方法是采用多芯片系统,即使用多个媒体处理器11。每个媒体处理器11连接若干媒体对象13,多个媒体处理器11之间通过其它途径交换数据。但是,由于媒体处理器11这类核心芯片一般比较贵,这种靠增加核心芯片来分担媒体对象13的方法不但会增加通信系统的复杂度,系统成本也会增加很多。

第三种方法是在每个媒体对象13的IO端口增加三态驱动芯片,同样地,虽然这种方法在一定程度上增强了媒体对象13的驱动能力,使媒体对象13的数量有所提高,但是,此方法需要对驱动芯片进行控制,这种控制有时比较麻烦,甚至难以实现,同时由于增加额外的驱动芯片,当IO端口数量很多时,成本上升明显。

发明内容

本发明的目的在于提供一种TDM总线扩展方法,通过本发明方法构造的通信系统所挂接的媒体对象的数量不受限制,实用性强。

为了实现上述目的,本发明采用了以下技术方案:

一种TDM总线扩展方法,其特征在于:它包括如下步骤:将TDM总线分成m+1组子总线,其中:1组子总线上挂接媒体处理器,该媒体处理器的TDM接口经由该子总线与可编程器件上相应的IO端连接;其余的m组子总线上分别挂接相应数量的媒体对象,各个媒体对象的TDM接口分别经由自身所挂接的子总线与该可编程器件上相应的IO端连接。

本发明的优点是:通过本发明方法构造的通信系统所挂接的媒体对象的数量不受限制,实用性强,且通信系统的工作速度不会因总线的改造而降低。本发明方法实现简便,成本低,简单对可编程器件编程就可实现,特别适用于大容量背板交换系统。

附图说明

图1是已有典型通信系统的组成示意图;

图2是本发明方法的实施说明图;

图3是通过本发明方法实现的一个通信系统的示意图。

具体实施方式

下面结合附图对本发明进行详细描述。

本发明TDM总线扩展方法包括如下步骤:将TDM总线(TDM_BUS)分成m+1组子总线,其中:1组子总线230(TDM_BUS0)上挂接媒体处理器210,该媒体处理器210的TDM接口经由该子总线230与可编程器件220上相应的IO端连接;其余的m组子总线231、232、……、23m(TDM_BUS1至TDM_BUSm)上分别挂接相应数量的媒体对象240,各个媒体对象240的TDM接口分别经由自身所挂接的子总线与可编程器件220上相应的IO端连接。

在本发明中,媒体对象240自身具有TDM接口,媒体处理器210自身也具有TDM接口。当然,也允许个别媒体对象没有TDM接口,而是在其外额外增设一个TDM接口模块。媒体对象240可为媒体芯片或媒体模块或媒体电路板。可编程器件220可为CPLD或FPGA,在实际使用中,只需对可编程器件简单编程即可实现通信,不必增加额外硬件成本。

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