[发明专利]信号处理装置与信号处理方法无效
申请号: | 201010109898.8 | 申请日: | 2010-02-02 |
公开(公告)号: | CN101800635A | 公开(公告)日: | 2010-08-11 |
发明(设计)人: | 井手直纪 | 申请(专利权)人: | 索尼公司 |
主分类号: | H04L7/033 | 分类号: | H04L7/033;H04L7/10 |
代理公司: | 北京市柳沈律师事务所 11105 | 代理人: | 黄小临 |
地址: | 日本*** | 国省代码: | 日本;JP |
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摘要: | |||
搜索关键词: | 信号 处理 装置 方法 | ||
技术领域
本发明涉及一种信号处理装置与一种信号处理方法。
背景技术
例如,作为数字调制方法,幅度调制方法和相位调制方法是公知的。幅度调制方法也被称为ASK(幅移键控)方法,即,一种依据传输数据改变载波的幅度的数字调制方法。幅度调制方法的另一已知示例是OSK(振荡键控)方法,其将数据与一幅度的出现或不出现相关联。另一方面,相位调制方法也被称为PSK(相移键控)方法,即,一种依据传输数据改变载波的相位的数字调制方法。相位调制方法的示例类型包括BPSK(二相相移键控)方法、QPSK(四相相移键控)方法等等。
当通过相位调制方法传输数据时,接收机通过例如同步解调方法再现载波,并且测量载波与所接收的信号之间的相位差,由此解调数据。日本专利申请特许公开第2008-294730号公开了相位解调方法的数据解调方法,并且更具体地公开了用于使用与载波具有相同频率的采样时钟来生成采样数据并且检测要采样的所接收的信号的正确相位范围的技术。在该技术中,使用与载波具有相同频率的采样时钟来确定所述数据和所述相位。因此,与现有技术中用于使用比载波高数倍的采样频率来处理数据的方法相比,该技术消除了对操作速率(operational rate)的要求。结果,该技术使得能够使用具有较高频率的载波来高效传输数据。
发明内容
将更详细地描述在日本专利申请特许公开第2008-294730号中描述的上述技术。首先,使用多个采样时钟采样所接收的信号,所述多个采样时钟具有彼此互不相同的相位,并且使用所获得的采样数据来生成上述多个采样时钟的各相位中每个相位的检测数据和相位数据。此外,在该技术中,基于所生成的检测数据和相位数据,选择具有与所接收的信号的相位最接近的相位 的采样时钟,解调使用所选择的采样时钟的相位所检测到的检测数据。该方法可以通过使用与载波具有相同频率的驱动时钟实现相位比较处理和数据检测处理,而无须使用模拟-数字转换。
然而,使用上述技术的装置包括多个逻辑单元,其包含使用未选择的采样时钟所生成的检测数据和相位数据,因此导致了相对复杂的电路配置和相对大的功率消耗。此外,在该技术中,当在采样时钟的相位中出现进位(carry)或借位(borrow)时,出现数据的重叠和丢失。在采样时钟中出现“进位”意味着以下:例如,当使用每一种都具有被延迟了1/8周期的相位的8种采样时钟时,“进位”意味着从被延迟了7/8周期的采样时钟切换到没有任何延迟的采样时钟。例如,当确定了由曼彻斯特码(Manchester)编码的调制信号时,在采样时钟中出现的进位直接导致数据的重叠或丢失。
考虑到以上内容,期望提供一种新颖且改进的信号处理装置和信号处理方法,其具有相对简单配置,但能够通过使用与载波具有几乎相同的频率的操作时钟来检测具有与输入相位调制信号接近的相位的采样数据。
根据本发明实施例,提供了一种信号处理装置,其包括:采样时钟生成单元,用于通过将与载波具有相同频率的驱动时钟的相位延迟预定量来生成采样时钟;逻辑数据生成单元,用于与驱动时钟同步地生成多个逻辑数据,其中,所述多个逻辑数据是通过使用由采样时钟生成单元生成的预定驱动时钟对通过偏移载波的相位而获得的调制信号进行采样而生成的;采样比特串生成单元,用于通过依据预定驱动时钟移位由逻辑数据生成单元生成的逻辑数据,来生成具有比载波的一个周期长的长度的采样比特串;相位误差数据生成单元,用于使用从由采样比特串生成单元生成的采样比特串中提取的与载波的一个周期相对应的比特串,来生成表示比特串的相位与载波的相位之间的偏移量的相位误差数据;以及提取位置确定单元,用于基于由相位误差数据生成单元生成的相位误差数据来确定与一个周期相对应的、具有与载波相位相似的相位的比特串的提取位置。
此外,逻辑数据生成单元可以与采样时钟的前沿时刻同步地采样输入信号,并且该逻辑数据生成单元包括多个寄存器,用于存储直到随后的前沿时刻为止的、通过采样获得的逻辑数据,第一级处的寄存器接收第一采样时钟以及充当输入信号的调制信号,第N级(N≥2)处的寄存器接收第一采样时钟或者其相位比第一采样时钟更接近预定驱动时钟的相位的采样时钟,并且 第N级(N≥2)处的寄存器还接收在第N-1级处的寄存器中存储的逻辑数据,并且采样比特串生成单元使用在最后一级处的寄存器中存储的逻辑数据来生成具有比载波的一个周期长的长度的采样比特串。
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