[发明专利]顺应高信号电平的输入/输出电路有效

专利信息
申请号: 200980126571.7 申请日: 2009-07-22
公开(公告)号: CN102089973A 公开(公告)日: 2011-06-08
发明(设计)人: 维贾伊·尚卡尔;阿贝克·古普塔;瓦伊什纳瓦·斯里尼瓦斯;维韦卡·莫汉 申请(专利权)人: 高通股份有限公司
主分类号: H03K19/00 分类号: H03K19/00
代理公司: 北京律盟知识产权代理有限责任公司 11287 代理人: 宋献涛
地址: 美国加利*** 国省代码: 美国;US
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摘要:
搜索关键词: 顺应 信号 电平 输入 输出 电路
【权利要求书】:

1.一种电平移位器,其包含:

上拉电路或下拉电路中的至少一者,其包含电子组件,所述电子组件具有小于由所述电平移位器输出的最大信号电平的可靠性限度;以及

计时电路,其耦合到所述上拉电路或所述下拉电路中的所述至少一者,所述计时电路可操作以控制将输入信号施加到所述上拉电路或所述下拉电路中的所述至少一者的时间,从而防止由所述电子组件经历的端子到端子信号电平超出所述可靠性限度。

2.根据权利要求1所述的电平移位器,其中所述电子组件包含晶体管。

3.根据权利要求2所述的电平移位器,其中所述晶体管安置成堆叠配置。

4.根据权利要求2所述的电平移位器,其中所述计时电路包含安置于所述电平移位器的输入与所述晶体管中的一晶体管的栅极之间以提供其延时操作的延迟。

5.根据权利要求1所述的电平移位器,其进一步包含:

所述上拉电路或所述下拉电路中的所述至少一者的另一者,所述上拉电路或所述下拉电路中的所述至少一者的所述另一者包含具有小于所述最大信号电平的可靠性限度的电子组件;以及

计时电路,其耦合到所述上拉电路或所述下拉电路中的所述另一者,所述计时电路可操作以控制将所述输入信号施加到所述上拉电路或下拉电路中的所述另一者的时间,从而防止由所述电子组件经历的端子到端子信号电平超出所述可靠性限度。

6.根据权利要求1所述的电平移位器,其中所述电平移位器操作以依据操作模式而将输入信号选择性地电平移位到第一信号电平及第二信号电平,所述第二信号电平为所述最大信号电平,且其中所述计时电路包括可操作以根据所述操作模式而改变施加所述输入信号的所述时间的模式选择输入。

7.根据权利要求6所述的电平移位器,其中所述第一信号电平为1.8伏或1.8伏以下,且所述第二信号电平为2.6伏或2.6伏以上。

8.一种电平移位器,其包含:

电平移位电路,其可操作以依据操作模式而将输入信号选择性地电平移位到第一信号电平及第二信号电平,其中所述第一信号电平小于所述第二信号电平,所述电路包含具有小于所述第二信号电平的可靠性限度的电子组件;以及

计时电路,其耦合到所述电平移位电路且可操作以控制将输入信号施加到电平移位电路的时间,从而防止由所述电子组件经历的端子到端子信号电平超出所述可靠性限度。

9.根据权利要求8所述的电平移位器,其中所述电平移位电路包含:

包含所述电子组件的下拉电路,所述计时电路耦合到所述下拉电路的输入。

10.根据权利要求8所述的电平移位器,其中所述电平移位电路包含:

包含所述电子组件的上拉电路,所述计时电路耦合到所述上拉电路的输入。

11.根据权利要求8所述的电平移位器,其中所述电平移位电路包含:

下拉电路;以及

上拉电路,其中所述下拉电路及所述上拉电路包含所述电子组件,且其中所述计时电路耦合到所述下拉电路的输入及所述上拉电路的输入。

12.根据权利要求11所述的电平移位器,其中所述电子组件包含晶体管。

13.根据权利要求12所述的电平移位器,其中所述上拉电路的晶体管安置成堆叠配置,且所述下拉电路的晶体管安置成堆叠配置。

14.根据权利要求12所述的电平移位器,其中所述第一信号电平为1.8伏或1.8伏以下,且所述第二信号电平为2.6伏或2.6伏以上。

15.一种方法,其包含:

提供电平移位电路,其可操作以依据操作模式而将输入信号选择性地电平移位到第一信号电平及第二信号电平,其中所述第一信号电平小于所述第二信号电平,所述电路包含具有小于所述第二信号电平的可靠性限度的电子组件;

将计时电路耦合到所述电平移位电路;以及

调适所述计时电路以控制将输入信号施加到电平移位电路的时间,从而防止由所述电子组件经历的端子到端子信号电平超出所述可靠性限度。

16.根据权利要求15所述的方法,其中所述提供电平移位电路包含:

提供下拉电路;以及

提供上拉电路,其中所述下拉电路及所述上拉电路包含所述电子组件。

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