[发明专利]主装置用接口装置、附属装置用接口装置、主装置、附属装置、通信系统、以及接口电压切换方法有效
| 申请号: | 200980101778.9 | 申请日: | 2009-02-27 |
| 公开(公告)号: | CN101910972A | 公开(公告)日: | 2010-12-08 |
| 发明(设计)人: | 外山昌之;吉田贵治;坂井敬介 | 申请(专利权)人: | 松下电器产业株式会社 |
| 主分类号: | G06F1/26 | 分类号: | G06F1/26 |
| 代理公司: | 中科专利商标代理有限责任公司 11021 | 代理人: | 汪惠民 |
| 地址: | 日本*** | 国省代码: | 日本;JP |
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| 摘要: | |||
| 搜索关键词: | 装置 接口 附属 通信 系统 以及 电压 切换 方法 | ||
1.一种主装置用接口装置,在与附属装置连接而进行数据或命令的收发的主装置中使用,且用于切换在所述附属装置与所述主装置之间的通信中使用的接口电压,其中,
所述主装置用接口装置具有:
时钟输出部,其输出用于进行所述数据或命令的收发的时钟信号;
端子群,具有1个或者多个输入输出端子部,且使用第1接口电压与第2接口电压中的任一个来进行所述数据或命令的收发;以及
接口电压切换部,其选择所述第1接口电压与所述第2接口电压中的任一个来切换在所述主装置与所述附属装置之间的通信中使用的接口电压,
所述接口电压切换部,具有:
控制器部;
时钟控制部,其由所述控制器部进行控制,当切换在所述主装置与所述附属装置之间的通信中使用的接口电压时,将所述时钟输出部输出的信号电平固定于第1信号电平,若所述主装置的接口电压的切换完成,则从所述时钟输出部输出基于切换后的接口电压的时钟信号;以及
输入输出端子控制部,其由所述控制器部进行控制,当切换在所述主装置与所述附属装置之间的通信中使用的接口电压时,使所述1个或者多个输入输出端子部处于输入状态,并监视对所述输入输出端子部输入的输入信号的信号电平,当检测到对所述输入输出端子部输入的输入信号的信号电平成为表示所述附属装置的接口电压的切换完成的信号电平时,将该检测结果通知给所述控制器部,
所述控制器部,当所述时钟控制部处于输出了基于切换后的接口电压的时钟信号的状态之后、并且从所述输入输出端子控制部接收到表示检测出所述附属装置的接口电压的切换完成的通知时,判定为所述附属装置的接口电压的切换已完成。
2.根据权利要求1所述的主装置用接口装置,其特征在于,
所述第1信号电平为低电平。
3.根据权利要求1或者2所述的主装置用接口装置,其特征在于,
所述控制器部,当切换在所述主装置与附属装置之间的通信中使用的接口电压时,使全部的所述输入输出端子部处于输入状态。
4.根据权利要求1至3中任一项所述的主装置用接口装置,其特征在于,
所述控制器部,若对所述输入输出端子部输入的输入信号在接口电压切换之后的接口电压中成为高电平,则判定为切换完成。
5.一种主装置用的接口装置,在与附属装置连接而进行数据或命令的收发的主装置中使用,且用于切换在所述附属装置与所述主装置之间的通信中使用的接口电压,其中,
所述主装置用接口装置具有:
时钟输出部,其输出用于进行所述数据或命令的收发的时钟信号;
端子群,具有1个或者多个输入输出端子部,且使用第1接口电压与第2接口电压中的任一个来进行所述数据或命令的收发;以及
接口电压切换部,其选择所述第1接口电压与所述第2接口电压中的任一个来切换在所述主装置与所述附属装置之间的通信中使用的接口电压,
所述接口电压切换部,具有:
控制器部;
时钟控制部,其由所述控制器部进行控制,当切换在所述主装置与所述附属装置之间的通信中使用的接口电压时,使所述时钟输出部输出的信号电平为基于第1信号电平的输出,若所述主装置的接口电压的切换完成,则从所述时钟输出部输出基于切换后的接口电压的时钟信号;以及
输入输出端子控制部,其由所述控制器部进行控制,当切换在所述主装置与所述附属装置之间的通信中使用的接口电压时,使所述1个或者多个输入输出端子部处于基于所述第1信号电平的输出状态,若所述主装置的接口电压切换完成,则将所述输入输出端子部从所述第1信号电平输出切换至输入状态,并监视对所述输入输出端子部输入的输入信号的信号电平,当检测到对所述输入输出端子部输入的输入信号的信号电平成为表示所述附属装置的接口电压的切换完成的信号电平时,将该检测结果通知给所述控制器部,
所述控制器部,当所述时钟控制部处于输出了基于切换后的接口电压的时钟信号的状态之后、并且从所述输入输出端子控制部接收到表示检测出所述附属装置的接口电压的切换完成的通知时,判定为所述附属装置的接口电压的切换已完成。
6.根据权利要求5所述的主装置用接口装置,其特征在于,
所述控制器部,当切换在所述主装置与附属装置之间的通信中使用的接口电压时,使全部的所述输入输出端子部处于基于所述第1信号电平的输出状态。
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