[实用新型]一种遥控接收控制电路有效

专利信息
申请号: 200920261602.7 申请日: 2009-12-17
公开(公告)号: CN201584048U 公开(公告)日: 2010-09-15
发明(设计)人: 任仕鼎 申请(专利权)人: 任仕鼎
主分类号: G08C17/02 分类号: G08C17/02
代理公司: 深圳市千纳专利代理有限公司 44218 代理人: 胡坚
地址: 518000 广东省深圳*** 国省代码: 广东;44
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摘要:
搜索关键词: 一种 遥控 接收 控制电路
【说明书】:

技术领域

本实用新型公开一种遥控器接收控制电路。

背景技术

随着科学的发展,遥控技术在人们的日常生活中应用越来越广泛,不胜枚举,现有的遥控接收控制电路的形式也是多种多样,而且应用领域十分广泛。其中比较大的用途,也是人们常见的用途就是应用于遥控玩具车上,作为遥控信号的接收。目前,在玩具车应用中所采用的遥控接收电路,主要有二种电路,一种是采用MCU实现,其功能灵活,可靠性好,但是成本高;另一种是专用的集成电路实现,其功能齐全,可靠性好,但是其缺点就是外围元件多,引脚多,封装成本较高,而且,现有技术中的专用的集成电路的小信号处理电路多是采用两级放大对小信号进行放大,并采用带通滤波器对小信号中所带的杂波进行滤除,其引脚多,接线复杂且效果不理想。为了解决上述问题,人们提供了新的遥控器接收控制电路,请参看申请人在先专利,专利名称为:遥控接收控制电路及其采用该电路制成的控制芯片,专利号为200820234852.7。但是,上述专利中的技术方案存在干扰信号的幅度与正常信号幅度相当时,迟滞比较器就无法滤除干扰的缺点。

发明内容

针对上述提到的现有技术中的遥控接收控制电路存在干扰信号的幅度与正常信号幅度相当时,迟滞比较器就无法滤除干扰的缺点,本实用新型提供一种新的遥控接收控制电路,其包括振荡器、主时钟电路、信号处理电路、复位电路、频率判别电路和逻辑输出电路,其中的信号处理电路包括依次串联连接的初级放大模块、次级放大模块、整形滤波模块和逻辑处理模块,输入信号经初级放大模块和次级放大模块进行放大后,再经整形滤波模块进行整形滤波后输出跟逻辑处理模块,逻辑处理模块对信号进行逻辑处理后,由输出端输出,解决上述问题。

本实用新型解决其技术问题采用的技术方案是:一种遥控接收控制电路,控制电路包括振荡器、主时钟电路、信号处理电路、复位电路、频率判别电路和逻辑输出电路,振荡器输出脉冲信号给主时钟电路,脉冲振荡信号经主时钟电路分频后分别提供时钟四分频信号F4、时钟八分频信号F8、反向时钟信号CKN、第二同步信号TB2和延迟输出信号NSOUT,遥控信号经过信号处理电路处理后输入给频率判别电路,经频率判别电路进行频率判别后输出给逻辑输出电路,通过外围的驱动电路驱动电机,信号处理电路包括依次串联连接的初级放大模块、次级放大模块、整形滤波模块和逻辑处理模块,输入信号经初级放大模块和次级放大模块进行放大后,再经整形滤波模块进行整形滤波后输出给逻辑处理模块,逻辑处理模块对信号进行逻辑处理后,由输出端输出数字滤波输出信号SCOUT给频率判别电路。

本实用新型解决其技术问题采用的技术方案进一步还包括:

所述的初级放大模块采用反相器放大电路,反相器放大电路采用反相器U13-A,反相器U13-A的输入端为初级放大模块的输入端,反相器U13-A的输出端为初级放大模块的输出端。

所述的次级放大模块采用反相器U14-A,场效应管Q3并联在反相器U14-A两端,场效应管Q3的栅极接地,反相器U14-A的输入端为次级放大模块的输入端,反相器U14-A的输出端为次级放大模块的输出端。

所述的整形滤波模块包括整形部分、采样部分和滤波部分,整形部分包括串联连接的反相器U1-A、反相器U2-A和反相器U3-A;采样部分包括串联连接的反相器U4-A和反相器U5-A,还有D触发器D18和D触发器D19,主时钟电路输出的时钟信号输入给反相器U4-A,反相器U4-A输出信号一路输入给反相器U5-A,另一路分别输入给D触发器D18和D触发器D19的CKB端,反相器U5-A输出信号分别输入给D触发器D18和D触发器D19的CK端,次级放大模块输入给D触发器D18的D端,D触发器D18的Q端输入给D触发器D19的D端;滤波部分包括与非门U12-A、与非门U16-A、与非门U17-A、或非门U6-A和反相器U15-A,与非门U12-A的两个输入端分别与D触发器D18的D端和D触发器D19的D端连接,与非门U12-A的输出端和与非门U16-A的一个输入端连接,与非门U16-A的另一个输入端和与非门U17-A的输出端连接,或非门U6-A的两个输入端分别与D触发器D18的D端和D触发器D19的D端连接,或非门U6-A的输出端与反相器U15-A的输入端连接,反相器U15-A的输出端和与非门U17-A的一个输入端连接,与非门U17-A的另一个输入端和与非门U16-A的输出端连接,与非门U17-A的输出端同时与逻辑处理模块的输入端连接。

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