[实用新型]一种高速数据复接路由及基带信号处理装置有效

专利信息
申请号: 200920107980.X 申请日: 2009-05-11
公开(公告)号: CN201414138Y 公开(公告)日: 2010-02-24
发明(设计)人: 张东伟;全升学;李媛;贾艳梅 申请(专利权)人: 北京国科环宇空间技术有限公司
主分类号: H04L25/05 分类号: H04L25/05;H04L12/56;H04Q11/00
代理公司: 北京德琦知识产权代理有限公司 代理人: 谢安昆;宋志强
地址: 100190北京市海*** 国省代码: 北京;11
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摘要:
搜索关键词: 一种 高速 数据 路由 基带 信号 处理 装置
【说明书】:

技术领域

实用新型涉及航天航空数据传输领域,尤其涉及一种高速数据复接路由及基带信号处理装置。

背景技术

目前,随着航天航空技术的飞速发展,飞行任务中搭载的有效载荷越来越多,传统的航天航空领域数据下行传输大多只有一个通道,现有的高速复接技术将多个有效载荷的数据复接为一路数据,然后对这一路数据进行存储和下行传输。

可见,现有技术无法解决对空间飞行器有效载荷数据的多路输入、多路输出问题,而只能对多个有效载荷数据以先进先出的方式下行传输;也正是由于这一缺陷,使地面控制系统不能根据任务的重要性、紧急性有针对性地选择部分数据优先下传,无法实时有效地获取数据。

另外,现有技术中对数据基带信号的处理需要多个单独的设备,集成度较差,这就增加了设备的数量、重量和功耗,降低了星载设备的可靠性。

实用新型内容

本实用新型提供一种高速数据复接路由及基带信号处理装置,能够实现航天航空系统领域中有效载荷数据的多入多出,保证实时有效地获取重要数据;还能够高度集成基带信号处理功能,提高星载设备的可靠性。

本实用新型的技术方案是这样实现的:

一种高速数据复接路由及基带信号处理装置,包括:输入数据预处理模块、输入路由存储模块、输出复接路由及基带信号处理模块和SoC控制模块;其中,

输入数据预处理模块,分别与数据源、SoC控制模块和输入路由存储模块连接,接收数据源输入的数据,按照SoC控制模块的命令将所述数据发送至输入路由存储模块;

输入路由存储模块,分别与SoC控制模块、输入数据预处理模块、输出复接路由及基带信号处理模块和存储器连接,接收输入数据预处理模块发送的数据,按照SoC控制模块的命令将所述数据发送至存储器,将所述数据的相关信息和逻辑地址反馈至SoC控制模块;还用于按照SoC控制模块的命令将所述数据发送至输出复接路由及基带信号处理模块;

输出复接路由及基带信号处理模块,分别与SoC控制模块、输入路由存储模块、存储器和下行通道连接,按照SoC控制模块的控制命令从存储器获取数据,还用于接收输入路由存储模块发送的数据,对所述数据进行基带信号处理并发送至下行通道;

SoC控制模块,分别与地面控制系统、输入数据预处理模块、输入路由存储模块和输出复接路由及基带信号处理模块连接;向输入数据预处理模块发送控制信号,命令其向输入路由存储模块发送数据;向输入路由存储模块发送分区表,命令其将接收的数据存储至分区表所指示的位置,接收输入路由存储模块反馈的数据的相关信息和逻辑地址,建立索引表;还用于向输入路由存储模块发送直传命令,命令其将接收的数据发送至输出复接路由及基带信号处理模块;接收地面控制系统的指令,查找所述索引表,获取该指令所要求的数据的逻辑地址,将所述逻辑地址发送至输出复接路由及基带信号处理模块,命令其从存储器获取数据。

可见,在本实用新型提出的高速数据复接路由及基带信号处理装置,通过SoC控制模块对整个装置进行管理和控制,实现了有效载荷数据的多入多出,保证地面及时获取重要数据;同时还集成了基带信号处理功能,提高了星载设备的可靠性。

附图说明

图1为本实用新型所应用系统的结构示意图;

图2为本实用新型提出的高速数据复接路由及基带信号处理装置的结构示意图。

具体实施方式

为使本实用新型的目的、技术方案和优点更加清楚明白,下面结合实施例和附图,对本实用新型进一步详细说明。

参见图1,图1为本实用新型所应用系统的结构示意图。本实用新型提出的高速数据复接路由及基带信号处理装置接收来自各有效载荷的多路数据,在存储模式下,将有效载荷数据按照分区表存入大容量存储器组中;直传模式下,有效载荷数据不经过存储直接通过下行通道下传至地面。在下行区域内,高速数据复接路由及基带信号处理装置按照地面控制指令的要求从大容量存储器组中路由读取数据,可以将数据经过加密、纠错编码、CCSDS打包、数据伪随机、8b/10b编码等处理后通过下行通道下行传输。地面控制系统根据任务特点、任务的紧急性可以指定特定的数据通过指定通道下行传输,提高了获得有效载荷数据的实时性和有效性。

参见图2,图2为本实用新型提出的高速数据复接路由及基带信号处理装置的结构示意图,该装置包括:输入数据预处理模块201、输入路由存储模块202、输出复接路由及基带信号处理模块203和SoC控制模块204;其中,

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