[实用新型]一种多模式兼容信道机有效
申请号: | 200920104069.3 | 申请日: | 2009-08-06 |
公开(公告)号: | CN201467124U | 公开(公告)日: | 2010-05-12 |
发明(设计)人: | 韩柏;赵彦惠;王伟;王栋梁;张永涛;薛冰;高建忠;王迎栋 | 申请(专利权)人: | 中国电子科技集团公司第五十四研究所 |
主分类号: | H04B7/00 | 分类号: | H04B7/00;H04B1/00 |
代理公司: | 石家庄科诚专利事务所 13113 | 代理人: | 王文庆 |
地址: | 050081 河北省石家庄市中*** | 国省代码: | 河北;13 |
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摘要: | |||
搜索关键词: | 一种 模式 兼容 信道 | ||
技术领域
本实用新型涉及通信领域中利用VHF低端频段的多种传输信道(流星余迹信道、Es层信道、地波信道)进行近中远不同距离通信的设备。
背景技术
目前,流星余迹通信系统中只利用流星余迹信道进行远距离的通信;同时,现有的流星余迹通信系统的抗频率选择性衰落和抗多径能力差,解调设备体积大,价格昂贵,通信性能不够理想。为满足用户采用同一设备完成近中距离的通信要求,为满足系统应具有较强的抗衰落和抗多径的能力,为满足设备体积轻巧的要求,因此迫切需要研制一种简单实用的多模式兼容通信设备,以满足用户需求。
实用新型内容
本实用新型的目的在于避免上述背景技术中的不足之处而提供一种采用失真自适应技术的兼容流星余迹信道、Es层信道、地波信道通信的装置,能够提供近中远不同距离下的通信,能有效提高系统的抗衰落和抗多径的能力。本实用新型还具有适应不同通信速率、性能稳定、重量轻、集成化程度高、操作简便等特点。
本实用新型的目的是这样实现的:
本实用新型包括接口单元、数据链路控制、调制器、发信机、功放、解调器、收信机、监控和电源,所述的接口单元的输入和输出端口1脚连接外部数据端口A,接口单元的输入和输出端口2脚连接监控器的输入和输出端口1脚,接口单元的输入和输出端口3脚连接数据链路控制的输入和输出端口1脚;数据链路控制的输出端口2脚连接调制器的输入端口1脚,数据链路控制的输入端口3脚连接解调器的输出端口1脚;调制器的输入和输出端口2连接监控的输入和输出端口2脚,调制器的输出端口3连接发信机的输入端口1脚;发信机的输出端口2脚连接功放的输入端口1脚;功放的输出端口连接外部端口B;解调器的输入和输出端口2脚连接监控的输入和输出端口3脚,解调器的输入端口3脚连接收信机的输出端口1脚;收信机的输入端口2脚连接外部端口C;电源的输出端口+V1、+V2和+V3分别连接到各个模块相应的电源端口。
所述的接口单元对来自外部端口A的不同终端的业务信息进行接口变换后发送至数据链路控制,数据链路控制对来自接口单元的数据成帧后发送至调制器;调制器对来自数据链路控制的数据调制到中频后输出至发信机;发信机对来自调制器的中频信号进行上变频、滤波处理后发送至功放;功放对来自发信机的信号放大后发送至外部端口B;收信机对来自外部端口C的信号进行低噪声放大、下变频、滤波处理后发送至解调器;解调器对来自收信机的信号解调后发送至数据链路控制;数据链路控制对来自解调器的数据进行分析,计算出成帧时所需的差错控制和流量控制参数,同时把数据发送给接口单元;接口单元对来自数据链路控制的数据进行接口变换后发送至外部端口A;监控监测各部件的工作状态并控制工作模式;电源为各部件提供电源。
本实用新型调制器包括频率合成、映射、成形、正交混频、D/A、低通滤波、时钟、锁相、10M钟,其中数据链路控制的输出端口2脚连接映射的输入端口1脚;时钟的输出端口1脚并接频率合成的输入端口1脚、映射的输入端口2脚、成形的输入端口2脚、正交混频的输入端口3脚,频率合成的输出端口2脚连接正交混频的输入端口2脚;映射的输出端口3脚连接成形的输入端口1脚;成形的输出端口3脚连接正交混频的输入端口1脚;正交混频的输出端口4脚连接D/A的输入端口1脚;D/A的输出端口2脚连接低通滤波的输入端口1脚;低通滤波的输出端口连接发信机的输入端口1脚;时钟的输入端口2脚连接锁相的输出端口1脚,时钟的输出端口3脚连接锁相的输入端口2脚;锁相的输入端口3脚连接10M钟的输出端口1脚。
所述的频率合成将产生中频信号;映射完成对输入的数据的符号映射;成形产生适合于信道传输和解调的信号波形;正交混频用于将调制信号的频谱搬移的中频;D/A将调制后的数字信号变换成模拟信号;低通滤波将滤除模拟调制信号中高频部分的干扰信号;时钟将产生调制器所需的工作时钟;锁相用于把时钟同步到10M钟上;10M钟提供了系统工作的本地参考钟。
本实用新型解调器包括载波同步、A/D、鉴相、积分、判决、时钟、位同步,其中A/D的输入端口1脚连接收信机的输出端口1脚,A/D的输入端口2脚连接时钟的输出端口1脚,A/D的输出端口3脚并接载波同步的输入端口1脚、鉴相的输入端口1脚;鉴相的输入端口2脚连接载波同步的输出端口2脚,鉴相的输出端口3脚连接积分的输入端口1脚;积分的输入端口2脚连接位同步的输出端口1脚,积分的输出端口3脚并接判决的输入端口1脚、位同步的输入端口2脚;判决的输出端口2脚并接数据链路控制的输入端口3脚、载波同步的输入端口3脚。
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