[发明专利]内存控制器有效

专利信息
申请号: 200910236805.5 申请日: 2009-10-30
公开(公告)号: CN101702326A 公开(公告)日: 2010-05-05
发明(设计)人: 聂华;邵宗有;历军;李静;刘新春;窦晓光 申请(专利权)人: 曙光信息产业(北京)有限公司
主分类号: G11C7/10 分类号: G11C7/10
代理公司: 北京市德恒律师事务所 11306 代理人: 梁永
地址: 100084 北*** 国省代码: 北京;11
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摘要:
搜索关键词: 内存 控制器
【权利要求书】:

1.一种内存控制器,其特征在于,所述内存控制器基于现场可编程门 阵列实现,所述内存控制器包括:

数据通道接口模块,用于根据内存所选用的颗粒规格将来自内存读引 擎和/或内存写引擎的访问请求的线性地址转换为段地址形式的地址,并控 制所述访问请求、待写入数据的存储;

地址存储模块,用于在所述数据通道接口模块的控制下存储由所述数 据通道接口模块转换后的所述访问请求;

数据存储模块,用于在所述数据通道接口模块的控制下存储来自所述 内存写引擎的待写入数据;

状态机模块,用于根据所述内存的内部状态发送内存操作命令以及所 述地址存储模块中存储的所述访问请求,其中,在发送的所述访问请求为 写请求的情况下,所述状态机模块进一步控制所述数据存储模块中存储的 所述待写入数据的调度;

物理接口模块,用于根据所述内存的数据要求对所述状态机模块发送 的所述访问请求和所述待写入数据进行转换处理并发送至所述内存,并且 用于根据所述内存控制器的数据要求对来自所述内存的数据进行转换并发 送至所述数据通道接口模块。

2.根据权利要求1所述的内存控制器,其特征在于,所述数据通道接 口模块还用于根据所述内存的突发长度要求,对来自所述内存读引擎和/或 所述内存写引擎的所述访问请求进行分解。

3.据权利要求1所述的内存控制器,其特征在于,所述数据通道接口 模块还用于对所述地址存储模块和所述数据存储模块的存储状态进行监 控。

4.根据权利要求1所述的内存控制器,其特征在于,所述段地址形式 的地址包括以下信息:所述内存的bank地址、行地址、列地址、以及片选 信号。

5.根据权利要求1所述的内存控制器,其特征在于,所述状态机模块 还用于在所述内存启动之前,根据所述内存的参数对所述内存进行初始化, 并在所述内存启动后对所述内存进行周期性刷新。

6.根据权利要求1所述的内存控制器,其特征在于,所述状态机模块 还用于保持所述内存中指定数目的bank处于活动状态。

7.根据权利要求1所述的内存控制器,其特征在于,所述状态机模块 还用于对所述地址存储模块中存储的访问请求的地址进行译码,并发送译 码后的所述访问请求。

8.根据权利要求1至7中任一项所述的内存控制器,其特征在于,

所述数据存储模块和所述地址存储模块均为先入先出存储器。

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