[发明专利]视频缩放技术有效

专利信息
申请号: 200910204999.0 申请日: 2009-09-29
公开(公告)号: CN101715126A 公开(公告)日: 2010-05-26
发明(设计)人: S·库路帕蒂 申请(专利权)人: 英特尔公司
主分类号: H04N7/26 分类号: H04N7/26;H04N7/36;G06T3/40
代理公司: 上海专利商标事务所有限公司 31100 代理人: 毛力;袁逸
地址: 美国加利*** 国省代码: 美国;US
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摘要:
搜索关键词: 视频 缩放 技术
【说明书】:

技术领域

本文中公开的主题一般涉及用于缩放图像的技术。

背景技术

图像缩放涉及放大或缩小图像的大小。常常使用多相滤波器来缩放图像。 经缩放的图像的质量倾向于随着多相滤波器抽头数目的增加而提高。理论上, 具有众多抽头的滤波器对于视频缩放而言工作良好。然而,对于图形以及人工 创建或再现的图像,使用多抽头多相滤波器对此类图像进行缩放会产生激荡伪 像。一种激荡形式是像素的色彩溢渗到毗邻像素中。激荡伪像在相异色彩之间 的单像素过渡周围最为明显。

附图简述

发明的实施例在各附图中是作为示例而非作为限制而示出的,在附图中 相同的附图标记指代相同的元素。

图1描绘了用于在缩放期间生成内插像素的现有技术。

图2描绘了根据本发明的实施例的视频缩放器。

图3描绘了根据本发明的实施例的视频缩放系统。

图4描绘了根据本发明的实施例的可用于确定像素的最小值和最大值的 伪码。

图5描绘了根据本发明的实施例的用于管理像素的值范围的方式的流程 图。

图6描绘了根据本发明的实施例的系统。

详细描述

贯穿本说明书,对“一个实施例”或“一实施例”的引用意味着结合该实施例 描述的特定特征、结构或特性被包括在本发明的至少一个实施例中。因此,在 贯穿本说明书的各个地方,短语“在一个实施例中”或“在一实施例中”的出现不 一定都指代同一实施例。此外,特定特征、结构或特性可被组合在一个或多个 实施例中。

图1描绘了在缩放期间用于生成内插像素的现有技术的伪码以及输入像 素流和经缩放的输出像素流的示例。输入像素流包括编号为0到9的诸像素。 在此示例中,应用两倍缩放。相应地,输出像素流包括多达输入像素流中那些 像素的两倍的像素。内插像素(示为“In”)被插入到输入像素之间。

接着参看图1中的现有技术伪码,变量num_input_pixels(数目_输入_像 素)代表输入像素的数目,该数目在此示例中为10。变量num_output_pixels (数目_输出_像素)代表缩放之后的输出像素的数目。在此示例中,变量 num_output_pixels为2*10,或即20。

变量phase_acc(相位_累加)导致输出视频流中的像素以变量isf为增量 呈递。变量isf为1/缩放因子,并且相应地,在此示例中,变量isf为0.5。第 一像素的phase_acc为0,而第一内插像素的phase_acc为0.5,因为其位于编 号为0和1的输入像素之间。第二内插像素的phase_acc为1.5,以此类推。变 量center_input_pixel(中心_输入_像素)代表在一内插像素之前的输入像素的 编号。变量phase(相位)是变量phase_acc的分数部分。可使用其他编号方案 来计及像素。

图2描绘了根据本发明的实施例的视频缩放器200的简化框图。缩放器 200包括水平视频缩放器202和垂直视频缩放器204。垂直视频缩放可在水平 视频缩放之前或之后。输入视频流被提供给水平视频缩放器202。输入视频流 可由诸如视频解码器等任意视频源或经由HDMI电缆提供。垂直视频缩放可缩 放图像中的一列像素。水平视频缩放可缩放图像中的一行像素。输出视频流可 被提供给至少一个显示器或视频处理块。

图3描绘了根据本发明的实施例的视频缩放系统300的简化框图。系统 300可被用在垂直或水平视频缩放器中。系统300包括滤波器310、范围计算 逻辑320、和像素调节器逻辑330。系统300可对一行像素(在水平视频缩放 器中)或一列像素(在垂直视频缩放器中)执行视频缩放。

例如,每个像素可被表示为一值。像素可被编码为RGB值。在此情形中, 系统300可限制每个像素的RGB值。像素可被编码为YCbCr,其中Y例如指 示亮度值,Cb指示蓝色差,而Cr指示红色差。在此类情形中,系统300可限 制每个像素的Y、Cb和Cr值。

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