[发明专利]采样保持电路及数字模拟转换电路有效
申请号: | 200910139966.2 | 申请日: | 2009-07-17 |
公开(公告)号: | CN101630533A | 公开(公告)日: | 2010-01-20 |
发明(设计)人: | 土弘 | 申请(专利权)人: | 恩益禧电子股份有限公司 |
主分类号: | G11C27/02 | 分类号: | G11C27/02;H03K19/0185;H03M1/66;G09G3/20;H03F3/45 |
代理公司: | 中原信达知识产权代理有限责任公司 | 代理人: | 孙志湧;李 亚 |
地址: | 日本*** | 国省代码: | 日本;JP |
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摘要: | |||
搜索关键词: | 采样 保持 电路 数字 模拟 转换 | ||
1.一种采样保持电路,
具有:第1电容元件及第2电容元件,在该第1电容元件及第2 电容元件中的至少一方的第1端子上输入有采样电压,该第1电容元 件及第2电容元件的第2端子彼此共同连接到基准电压端子;
第1开关,连接在上述第1电容元件及第2电容元件的上述第1 端子之间;以及
差动电路,
上述差动电路包括具有第1输入、第2输入的差动输入级,上述 差动输入级的上述第2输入连接到上述第2电容元件的上述第1端子,
上述差动电路还包括:
第2开关,连接在上述差动输入级的第1输入和上述第1电容元 件的上述第1端子之间;
放大级,由输入接收上述差动输入级的输出,输出连接到采样保 持电路的输出端子;以及
第3开关,连接在上述差动输入级的上述第1输入和上述放大级 的输出之间。
2.根据权利要求1所述的采样保持电路,其中,
一个数据期间具有第1期间、第2期间、第3期间,
在上述第1期间,使上述第1开关及第3开关断开,使上述第2 开关接通,向上述第1电容元件及第2电容元件中的至少一方的上述 第1端子提供上述采样电压,
在上述第2期间,使上述第2开关接通,使上述第3开关断开, 使上述第1开关接通,在上述第1电容元件及第2电容元件之间进行 电荷再分配,
在上述第3期间,使上述第1开关及第2开关断开,使上述第3 开关接通,差动放大上述第1输入及第2输入的电压的上述差动电路 的输出信号输出到上述输出端子。
3.根据权利要求1所述的采样保持电路,其中,
上述差动输入级具有:
第1电流源及第2电流源,该第1电流源及第2电流源的第1端 子连接到第1电源端子;
第1MOS晶体管,栅极端子构成上述第1输入,经由上述第2开 关连接到上述第1电容元件的上述第1端子,并且经由上述第3开关 连接到采样保持电路的上述输出端子,源极端子连接到上述第1电流 源的第2端子;
第2MOS晶体管,栅极端子构成上述第2输入,连接到上述第2 电容元件的上述第1端子,源极端子连接到上述第2电流源的第2端 子,并且经由第4开关连接到上述第1MOS晶体管的源极;以及
负载电路,连接在上述第1MOS晶体管及第2MOS晶体管的漏极 端子和第2电源端子之间。
4.根据权利要求3所述的采样保持电路,其中,
一个数据期间具有第1期间、第2期间、第3期间,
在上述第1期间,使上述第1开关、第3开关、第4开关断开, 使上述第2开关接通,向至少上述第1电容元件的上述第1端子及上 述差动输入级的上述第1输入提供上述采样电压,
在上述第2期间,使上述第2开关接通,使上述第3开关断开, 使上述第4开关断开,使上述第1开关接通,在上述第1电容元件及 第2电容元件之间进行电荷再分配,
在上述第3期间,使上述第1开关及第2开关断开,使上述第3 开关及第4开关接通,上述差动电路的放大结果输出到上述输出端子。
5.根据权利要求1所述的采样保持电路,其中,
具有对上述差动输入级的输出和上述放大级的输入之间的连接进 行接通/断开控制的第5开关。
6.根据权利要求3所述的采样保持电路,其中,
具有向上述第1电容元件及第2电容元件中的至少一方的上述第 1端子提供上述采样电压的电压供给电路。
7.根据权利要求6所述的采样保持电路,其中,
上述电压供给电路在电压供给端子与上述第1电容元件及第2电 容元件中的至少一方的上述第1端子之间具有开关。
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