[发明专利]一种自动发电控制目标负荷预处理装置有效

专利信息
申请号: 200910042133.4 申请日: 2009-08-25
公开(公告)号: CN101645599A 公开(公告)日: 2010-02-10
发明(设计)人: 黄卫剑;伍宇忠;李锋 申请(专利权)人: 广东电网公司电力科学研究院
主分类号: H02J3/00 分类号: H02J3/00;H02J13/00
代理公司: 广州知友专利商标代理有限公司 代理人: 周克佑
地址: 510600广*** 国省代码: 广东;44
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摘要:
搜索关键词: 一种 自动 发电 控制 目标 负荷 预处理 装置
【说明书】:

技术领域

发明涉及一种自动发电控制(Automatic Generation Control,简称AGC)目标负荷预处理装置,尤其涉及一种对AGC目标负荷采用先判断、后传送的AGC目标负荷预处理装置。 

背景技术

火电机组AGC接口是联系机组侧与调度侧,实现机组自动发电控制(AGC)的重要通道,其中,AGC目标负荷是调度侧实时调度机组负荷的唯一信号。但调度侧与机组侧距离往往相距几十千米到上千千米,经过的设备包括调度侧主站控制系统(EMS)、调度侧网络通信站(RTU)、信号传输、电厂侧网络通信站(RTU)、机组侧协调控制系统(CCS)等环节,使得AGC目标负荷信号经常出现掉线、故障、外界干扰、信号超过允许上/下限、操作员输入错误等问题,影响机组运行的安全和机组AGC的实际投入。目前,所有机组对AGC目标负荷信号仅采用简单的坏值处理和高、低限限制处理,AGC目标信号的瞬时异常均导致AGC功能的退出,另外,也没有对AGC目标信号的超步长变化和反向变化作任何的限制,而AGC目标信号的异常对机组的安全性和稳定性会产生较大的影响。 

发明内容

本发明的目的,就在于提供一种能提供报警及有效克服AGC目标信号异常、提高AGC安全性能和提高机组AGC投入率的信号处理装置。 

本发明提供的AGC目标信号预处理装置,包括:信号品质测试回路(I)、高低限监视报警回路(II)、偏差运算及监视报警回路(III)和信号异常综合报警回路(V): 

所述的信号品质测试回路含:1个质量判断TQ模块(01),当输入的AGC目标指令超出变送器量程的高低限时,发出坏质量报警至信号异常综合报警回路(V); 

所述的高低限监视报警回路含:第一ALARM高低限监视报警模块(02),输入有AGC目标上限和下限,以及AGC目标原始值,当AGC目标原始值大于AGC目标上限或低于AGC目标下限时,发出报警至信号异常综合报警回路(V); 

所述的偏差运算及监视报警回路含:第一、第二乘法模块(03、04)、第一DEV偏差运算和报警模块(05)、第二高低限监视报警模块(06)及第一延时通模块(07); 

第一乘法模块(03)输出AGC允许最大正向步长报警限(AGC允许的最大步长的(0.8--1.2)倍),第二乘法模块(03)输出AGC允许最大反向步长报警限(AGC允许的最大步长的(-0.8--1.2)倍); 

第一DEV偏差运算和报警模块(05)输入AGC允许的最大步长的±(0.8-1.2)倍、AGC目标原始值与切换模块(27)输出的预处理后的AGC目标值(此值为回路(VI)的输出的内部连接信号),当AGC目标原始值与预处理后的AGC目标值的偏差超过AGC允许最大正向步长报警限(AGC允许的最大步长的(0.8--1.2)倍)时,第一DEV偏差运算和报警模块(05)的输出D端发出报警信号至信号异常综合报警回路(V); 

AGC目标信号异常综合报警回路(V):包括第三或逻辑模块(23)和第四延时通模块(24),第三或逻辑模块(23)输入质量判断TQ模块(01)、第一ALARM高低值监视报警模块(02)和第一DEV偏差运算和报警模块(05)的报警输出信号,如任一报警信号为真并持续超过预定时间(1秒-600秒),则第四延时通模块(24)输出为真,向机组控制系统和运行人员发出报警,并强制退出机组AGC方式。 

在上述基础上,本发明还可以做进一步的改进: 

AGC目标信号接收和传输模块(VI):包括第四非逻辑模块(25)、第三与逻辑模块(26)和第三切换模块(27); 

第四非逻辑模块(25)输入信号异常综合报警回路(V)第三或逻辑模块(23)的输出; 

第三与逻辑模块(26)输入第四非逻辑模块(25)输出、第三延时通模块(07)输出的AGC目标变化步长有效信号及第二或逻辑模块(22)输出的AGC信号方向变化允许信号至第三切换模块(27); 

第三切换模块(27)的输入还有AGC目标原始输入值; 

当第三或逻辑模块(23)的输出为假、AGC目标变化步长有效、AGC信号方向变化允许时,第三与逻辑模块(26)输出为真,第三切换模块(27)输出的预处理后的AGC目标值等于AGC目标原始输入值;当第三与逻辑模块(26)输出为假,第三切换模块(27)输出的输出值保持。 

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