[发明专利]均衡器以及配置此均衡器的方法无效
申请号: | 200910002983.1 | 申请日: | 2009-01-23 |
公开(公告)号: | CN101789917A | 公开(公告)日: | 2010-07-28 |
发明(设计)人: | 李宜霖;黄正壹 | 申请(专利权)人: | 瑞昱半导体股份有限公司 |
主分类号: | H04L25/03 | 分类号: | H04L25/03 |
代理公司: | 北京市柳沈律师事务所 11105 | 代理人: | 钱大勇 |
地址: | 中国台湾新*** | 国省代码: | 中国台湾;71 |
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摘要: | |||
搜索关键词: | 均衡器 以及 配置 方法 | ||
技术领域
本发明有关一种均衡器及其相关配置方法,尤指一种具有混合结构的均衡器及其相关配置方法。
背景技术
于通讯系统中传输信号时,随着通道(channel)长度的增加,信号的通道衰减与码元间干扰(inter-symbol interference,ISI)的情况会越严重,而降低了信号的品质。因此,通常会在信号的接收端设置一均衡器,来对所接收到的接收信号进行均衡处理,以补偿该接收信号的衰减并消除码元间干扰的问题。
目前常见的均衡器包含有线性前馈均衡器(Linear Feed-forwardequalizer,LE)以及判决反馈均衡器(Decision-feedback equalizer,DFE),其中判决反馈均衡器又包含一个前馈滤波器以及一个反馈滤波器,而线性前馈均衡器与判决反馈均衡器中的前馈滤波器的一般作法是针对等时间间隔的取样数据来做权重相加(weighted sum),在此称之为等间隔均衡器(Equally-spaced equalizer)。常见的等间隔均衡器则可分为码元间隔均衡器(symbol-spaced equalizer)以及分数间隔均衡器(fractionally-spacedequalizer),其中分数间隔均衡器的效能较码元间隔均衡器来得好,且受到时序相位偏移(timing phase offset)的影响较小,但是分数间隔均衡器较不稳定,且有消耗功率大以及较复杂等缺点。
发明内容
本发明的目的之一在于提供一种均衡器及其配置方法,其可根据均衡器中每一接头的特性(例如系数)来控制均衡器的取样间隔,以解决先前技术中的问题。
本发明的实施例披露了一种均衡器。均衡器包含具有多个接头以级联方式耦接在一起的接头延迟线以及加法器。接头延迟线用以接收一输入信号、多个接头控制信号及多个接头系数,并产生多个已相乘信号,其中多个接头被划分成多个群组。加法器耦接于该接头延迟线,用来相加多个已相乘信号以产生一输出信号。
本发明的实施例另披露了一种均衡器的配置方法,均衡器包含有以级联方式耦接在一起的多个接头所形成的一接头延迟线以及一加法器。该方法包含有:将多个接头划分成一第一群组以及一第二群组,其中,第一群组的第一取样间隔与第二群组的第二取样间隔不相同;以及将多个接头所产生的多个已相乘信号进行相加,以产生一输出信号。
本发明的实施例另披露了一种均衡器,包含有一接头延迟线以及一加法器。接头延迟线具有以级联方式耦接在一起的多个接头,接头延迟线用以接收一输入信号、一接头控制信号及一接头系数信号,并产生一已相乘信号,且多个接头被划分成至少一群组。加法器耦接于接头延迟线,用以接收已相乘信号,并依据已相乘信号来产生一输出信号。其中,多个接头中的任意一个接头皆可被禁能或者致能。
本发明的实施例另披露了一种均衡器的配置方法,均衡器包含有以级联方式耦接在一起的多个接头所形成的一接头延迟线以及一加法器。该方法包含有:将多个接头划分成至少一群组;依据一接头系数信号禁能该至少一群组中所包含的多个接头中的任意一个接头;以及将该至少一群组中所包含的多个接头中没有被禁能的接头所产生的多个已相乘信号进行相加,以产生一输出信号。
附图说明
图1为本发明的均衡器的第一实施例的示意图。
图2为本发明的均衡器的第二实施例的示意图。
图3为本发明的均衡器的第三实施例的示意图。
图4为本发明的均衡器的第四实施例的简易示意图。
图5为本发明的均衡器的第五实施例的示意图。
图6为本发明的均衡器的第六实施例的示意图。
具体实施方式
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