[发明专利]移位寄存器和显示装置有效
| 申请号: | 200880116732.X | 申请日: | 2008-08-18 |
| 公开(公告)号: | CN101868833A | 公开(公告)日: | 2010-10-20 |
| 发明(设计)人: | 大河宽幸;古田成;佐佐木宁;村上祐一郎 | 申请(专利权)人: | 夏普株式会社 |
| 主分类号: | G11C19/00 | 分类号: | G11C19/00;G02F1/133;G09G3/20;G09G3/36;G11C19/28 |
| 代理公司: | 北京市隆安律师事务所 11323 | 代理人: | 权鲜枝 |
| 地址: | 日本*** | 国省代码: | 日本;JP |
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| 摘要: | |||
| 搜索关键词: | 移位寄存器 显示装置 | ||
技术领域
本发明涉及移位寄存器和显示装置,特别涉及合适地应用于显示装置、摄像装置的驱动电路等的移位寄存器和使用该移位寄存器的显示装置、摄像装置。
背景技术
有源矩阵型的显示装置以行为单位选择2维状配置的显示元件且对所选择的显示元件写入与显示数据相应的电压,由此显示视频。为了以行为单位选择显示元件,使用根据时钟信号而使输出信号顺序移位的移位寄存器作为扫描信号线驱动电路。另外,在进行点顺序驱动的显示装置中,在数据信号线驱动电路的内部设有相同的移位寄存器。
在液晶显示装置中,有时使用用于形成显示元件内的TFT(Thin Film Transistor:薄膜晶体管)的制造工艺,与显示元件一体地形成显示元件的驱动电路。在这种情况下,为了削减制造成本,优选用与TFT相同导电型的晶体管形成包括移位寄存器的驱动电路。另外,当增加对移位寄存器施加的时钟信号的个数时,时钟配线用的布设面积、功耗等增加。从这样的背景出发,需要使用相同导电型的晶体管并根据2相的时钟信号进行动作的移位寄存器。在将这种移位寄存器用于液晶显示装置的情况下,有时当导通或者截止液晶显示装置的电源电路时所发生的视频混乱能被人眼看见,因此,观众会感到不愉快。
因此,当导通电源电路时,只要进行从移位寄存器的所有输出端子输出高电平的输出信号的全导通动作,就能够缓和画面所显示的视频的混乱。作为能够进行这种全导通动作的移位寄存器,已知在日本特开2002-197885号公报中所记载的移位寄存器。
图21是日本特开2002-197885号公报所记载的移位寄存器所包含的信号保持块的电路图。说明图21示出的信号保持块的动作。该信号保持块所包含的晶体管全部是N沟道型晶体管。当移位寄存器进行全导通动作时,晶体管T11、T12、T13成为截止状态。另外,对连接成二极管的晶体管T16的漏极端子施加电源电压VDD,因此,节点NB的电位成为高电平,晶体管14成为导通状态。因此,当从外部对控制端子CTL施加电平是Va(高电平)的输出控制信号SET时,节点Nout的电位成为(Va-Vth)(此处,Vth为晶体管T14的阈值电压)。因此,从输出端子OUT输出电位为(Va-Vth)的输出信号OTk。其它的信号保持块也同样地同时输出高电平的输出信号。因此,由这种信号保持块构成的移位寄存器能够进行全导通动作。专利文献1:日本特开2002-197885号公报
发明内容
发明要解决的问题
但是,在上述以往的电路中,当通常动作时噪声从外部进入时,有时晶体管T13成为导通状态。此时,直通电流流到晶体管T13、T14,因此,存在驱动移位寄存器的电源的功耗增大的问题。另外,控制端子CTL通过晶体管T14从输出端子OUT连接到液晶显示面板的扫描信号线,因此,还存在输出控制信号线的负荷变大的问题。
因此,本发明的目的在于提供在单元电路内直通电流不流动,并且全导通控制信号线的负荷不会变大的移位寄存器。
用于解决问题的方案
本发明的第1方案是一种移位寄存器,具有将包括相同导电型的晶体管的单元电路级联连接而成的结构,根据包括第1时钟信号和第2时钟信号的2相的时钟信号进行动作,其特征在于:
上述单元电路具备:
第1输出端子,其用于对外部输出第1输出信号;
第2输出端子,其用于对后一级的单元电路的输入端子输出第2输出信号;
第1输出信号生成电路,其对上述第1输出端子输出导通电压和截止电压中的任一方作为上述第1输出信号;
第2输出信号生成电路,其对上述第2输出端子输出导通电压和截止电压中的任一方作为上述第2输出信号;以及
全导通输出信号生成电路,其对上述第1输出端子输出导通电压作为上述第1输出信号,
当对上述单元电路施加激活的全导通控制信号时,上述第1输出信号生成电路停止输出上述导通电压的第1输出信号,同时上述全导通输出信号生成电路对上述第1输出端子输出上述导通电压的第1输出信号,并且,上述第2输出信号生成电路对上述第2输出端子输出上述截止电压的第2输出信号。
本发明的第2方案的特征在于:在本发明的第1方案中,
上述第1输出信号生成电路具备:
第1输出控制晶体管,其一方导通端子被施加上述第1时钟信号,另一方导通端子连接到上述第1输出端子;和
第1输出复位晶体管,其一方导通端子连接到上述第1输出控制晶体管的上述另一方导通端子,另一方导通端子被施加截止电压,
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