[发明专利]制造自对准镶嵌存储器结构的方法有效
申请号: | 200880019869.3 | 申请日: | 2008-04-10 |
公开(公告)号: | CN101689551A | 公开(公告)日: | 2010-03-31 |
发明(设计)人: | K-J·夏;C·李;C·派蒂 | 申请(专利权)人: | 桑迪士克3D公司 |
主分类号: | H01L27/115 | 分类号: | H01L27/115;H01L21/8247 |
代理公司: | 北京纪凯知识产权代理有限公司 | 代理人: | 赵蓉民 |
地址: | 美国加利*** | 国省代码: | 美国;US |
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摘要: | |||
搜索关键词: | 制造 对准 镶嵌 存储器 结构 方法 | ||
1.一种形成存储器单元的结构的方法,所述方法包括:
a)形成重掺杂半导体材料的第一柱形元件;
b)形成具有与所述第一柱形元件自对准的开口的第一类绝缘材料 的塑模;及
c)在所述塑模上沉积第二半导体材料以形成置于所述第一柱形元 件上并且与所述第一柱形元件对准的第二柱形元件。
2.根据权利要求1所述的方法,其中形成所述第一柱形元件的步 骤包括在导体上沉积半导体层并且在所述半导体层上沉积第二类电介 质的层;及
图案化并蚀刻所述半导体层和所述第二类电介质的所述层以形成 顶部覆盖柱形电介质层的所述第一柱形元件。
3.根据权利要求2所述的方法,其中形成塑模的步骤包括沉积第 一类电介质以便填充所述第一柱形元件周围的空间并且移除所述第二 电介质材料以形成所述塑模。
4.根据权利要求2所述的方法,其中所述重掺杂半导体材料是N 型,并且所述第二类电介质是Si3N4。
5.根据权利要求2所述的方法,其中所述重掺杂半导体是N型并 且进一步包括掺杂至少部分所述第二柱形元件以形成重掺杂P型区的 步骤。
6.根据权利要求2所述的方法,其中所述重掺杂半导体是P型并 且进一步包括掺杂至少部分所述第二柱形元件以形成重掺杂N型区的 步骤。
7.根据权利要求1所述的方法,其中形成所述第一柱形元件的步 骤包括在重掺杂半导体材料的所述第一柱形元件构成的部分上形成具 有由牺牲材料组成的部分的柱,并且形成塑模的步骤包括使用所述第 一类绝缘材料填充所述柱周围的空间并且移除所述牺牲材料以形成具 有与所述柱部分对准的开口的所述塑模。
8.根据权利要求7所述的方法,进一步包括形成具有沟槽的电介 质塑模,所述沟槽在在所述第二柱形元件上并与所述第二柱形元件基 本对准,以及掺杂部分所述第二半导体层以形成第二重掺杂半导体区。
9.根据权利要求8所述的方法,其中形成所述电介质塑模进一步 包括在所述第二半导体柱形元件上形成本征氧化物;在所述第二半导 体柱形元件和所述第一绝缘材料上沉积电介质层;蚀刻所述电介质层 以在每一侧具有空间的所述第二柱形元件上形成对准的电介质材料轨 道;使用电介质材料填充所述空间;以及移除电介质材料线路以在所 述第二柱形元件上形成基本对准的所述沟槽。
10.根据权利要求7所述的方法,进一步包括使用导电材料填充所 述沟槽以形成导体。
11.一种形成存储器单元的方法,其包括:
a)形成柱形半导体元件,其包括重掺杂的第一半导体层和位于所 述第一半导体层上并且与所述第一半导体层对准的第二半导体层;
b)形成具有位于所述柱形半导体元件上方且与所述柱形半导体元 件基本对准的图案化沟槽开口的第一绝缘材料的塑模;
c)掺杂部分所述第二半导体层以形成第三半导体层;
d)使用导电材料填充所述沟槽。
12.根据权利要求11所述的方法,其中形成所述塑模的步骤包括 在所述第二半导体层上形成电介质层;图案化和蚀刻所述电介质以形 成与所述柱形半导体元件对准的所述电介质的轨道;使用所述第一绝 缘材料填充所述电介质轨道周围的空间;及移除所述电介质轨道以形 成所述沟槽。
13.根据权利要求11所述的方法,其中所述第一半导体层是N型 半导体并且所述绝缘材料是SiO2。
14.根据权利要求11所述的方法,进一步包括形成置于所述第三 半导体层上的反熔丝层。
15.根据权利要求12所述的方法,进一步包括在填充所述电介质 轨道周围的所述空间后进行平坦化以暴露所述轨道。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L27-00 由在一个共用衬底内或其上形成的多个半导体或其他固态组件组成的器件
H01L27-01 .只包括有在一公共绝缘衬底上形成的无源薄膜或厚膜元件的器件
H01L27-02 .包括有专门适用于整流、振荡、放大或切换的半导体组件并且至少有一个电位跃变势垒或者表面势垒的;包括至少有一个跃变势垒或者表面势垒的无源集成电路单元的
H01L27-14 . 包括有对红外辐射、光、较短波长的电磁辐射或者微粒子辐射并且专门适用于把这样的辐射能转换为电能的,或适用于通过这样的辐射控制电能的半导体组件的
H01L27-15 .包括专门适用于光发射并且包括至少有一个电位跃变势垒或者表面势垒的半导体组件
H01L27-16 .包括含有或不含有不同材料结点的热电元件的;包括有热磁组件的