[实用新型]液晶显示装置无效
申请号: | 200820055820.0 | 申请日: | 2008-02-29 |
公开(公告)号: | CN201159982Y | 公开(公告)日: | 2008-12-03 |
发明(设计)人: | 朱修剑 | 申请(专利权)人: | 上海广电光电子有限公司 |
主分类号: | G09G3/36 | 分类号: | G09G3/36;G02F1/133 |
代理公司: | 上海专利商标事务所有限公司 | 代理人: | 陈亮 |
地址: | 200233上*** | 国省代码: | 上海;31 |
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摘要: | |||
搜索关键词: | 液晶 显示装置 | ||
技术领域
本实用新型涉及一种液晶显示装置,尤其涉及一种通过改变驱动第二栅极线的时钟信号的液晶显示装置。
背景技术
液晶显示器(LCD)是利用夹在液晶分子上电场强度的变化,改变液晶分子的取向控制透光的强弱来显示图像。目前,液晶显示器由于其具有的重量轻、体积小、厚度薄的特点,已广泛地被用在各种大中小尺寸的终端显示设备中。一般来讲,液晶显示器包括具有像素矩阵的液晶显示板和用于驱动该液晶显示板的驱动电路。
如图1所示,液晶显示器包括:液晶显示面板11,其具有像素矩阵;栅极驱动器12,用于对液晶显示面板11的栅极线GL进行驱动选通;源极驱动器13,用于对液晶显示面板11的数据线DL进行驱动;其中,栅极驱动器12和源极驱动器13由时序控制器14控制。
在液晶显示面板11,在栅极线GL和数据线DL间交叉的各个区域中存在液晶,液晶单元Clc在液晶显示面板11中形成矩阵分布;在交叉的区域中,存在一个n型薄膜晶体管nTFT,当nTFT所处的栅极线GL被选通时,数据线DL的数据信号充入液晶单元Clc,并由存储电容Cs保持该数据信号;液晶单元Clc根据充入的电平与公共电极Vcom的压差来改变液晶的状态,从而控制透光率以实现灰阶显示。现有技术的栅极驱动原理如图2所示,对于n条栅极线GL1~GLn的驱动来说,在一帧的T2周期内,每条栅极线的被选通的时间为T1,有n×T1<T2;同时,为了避免每条栅极线选通时被误充入下一条栅极线才需充入的数据线DL上的数据信号,必须有如下关系:(t2-t1)≥0。
为了提高液晶显示器的显示质量,在现有技术的液晶显示器结构上有如图3的技术改造。如图3所示,在液晶显示单元中增设了一个TFT,该处的TFT由增设的第二栅极线2GL选通驱动;第二栅极线2GL由第二栅极驱动器31进行驱动。当第二栅极线2GL上的TFT被选通时,液晶单元Clc不需要从数据线DL上充入数据信号,而是对应非数据线DL上的另外某个电平Vd进行充电动作。这样的技术方案,由于增加了一个TFT单元和第二栅极线2GL,降低了液晶显示器的开口率。因此,需要将增加的TFT单元和第二栅极线2GL的尺寸最小化处理。因此,当采用原有的栅极驱动方案对第二栅极驱动进行驱动时,对于n条第二栅极线2GL的驱动来说,在一帧的T2周期内,每条第二栅极线2GL的被选通的时间为T1,同样有n*T1<T2。为了保证第二栅极线2GL被选通时有足够的充电时间,也就约束了增加的TFT单元和第二栅极线2GL的尺寸降低幅度。因此,需要有更好的对第二栅极进行驱动的方法。
发明内容
本实用新型的目的在于提供了一种液晶显示装置,更加适合于降低第二栅极线2GL尺寸和该条栅极线上TFT尺寸的要求。
本实用新型的技术方案为:本实用新型揭示了一种液晶显示装置,包括:
液晶显示面板,包括多条第一栅极线、多条第二栅极线、多条数据线以及在该些第一栅极线和该些数据线交叉的区域中呈矩阵分布的液晶单元,对应每一个液晶单元,在该交叉的区域中存在一个第一薄膜晶体管,当该第一薄膜晶体管所处的第一栅极线被选通时,数据线上的数据信号充入该液晶单元;其中在每一液晶单元上还设有一个第二薄膜晶体管,由该第二薄膜晶体管所处的第二栅极线选通驱动,当该第二薄膜晶体管所处的第二栅极线被选通时,该液晶单元是从该第二薄膜晶体管上的一电平进行充电;
时序控制器,产生时序控制信号;
源极驱动器,在该时序控制信号的控制下对该液晶显示面板的数据线进行驱动;
第一栅极驱动器,在该时序控制信号的控制下对该液晶显示面板的第一栅极线进行驱动选通;
第二栅极驱动器,对该液晶显示面板的第二栅极线进行驱动选通;
时序控制单元,产生控制该第二栅极驱动器的信号,在一帧的周期T2内,每条第二栅极线被选通的时间为T1,存在n×T1>T2,其中n为第二栅极线的数量,每条第二栅极线被选通的时刻t2和前一条第二栅极线关闭的时刻t1有(t2—t1)<0的关系。
上述的液晶显示装置,其中,对于该时序控制单元,其产生的时钟信号中,每条第二栅极线被选通的时刻t2、前一条第二栅极线关闭的时刻t1以及每条第二栅极线被选通的时间T1之间存在如下的关系:(t1-t2)=T1/2。
上述的液晶显示装置,其中,该时序控制单元包括:
串联的多个移位寄存器,每一移位寄存器都连有该第一栅极驱动器的时钟信号;
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