[实用新型]基于三元内容寻址存储器通用现场总线接收机有效

专利信息
申请号: 200820012076.6 申请日: 2008-04-11
公开(公告)号: CN201178429Y 公开(公告)日: 2009-01-07
发明(设计)人: 于海斌;辛晓宁;杨志家;张志鹏;吕岩;谢闯;崔书平 申请(专利权)人: 中国科学院沈阳自动化研究所
主分类号: H04L29/06 分类号: H04L29/06;H04L12/40
代理公司: 沈阳科苑专利商标代理有限公司 代理人: 许宗富;周秀梅
地址: 110016辽宁*** 国省代码: 辽宁;21
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摘要:
搜索关键词: 基于 三元 内容 寻址 存储器 通用 现场总线 接收机
【权利要求书】:

1.一种三元内容寻址存储器通用现场总线接收机,其特征在于包括:

位同步电路输出有效数据采样点信息至采样点生成电路;

采样点生成电路,接收位同步电路有效数据采样点信息,输出两路信号,一路采样后数据送至移位寄存器;另一路接收数据脉冲个数给计数控制电路;

极性矫正电路,接收指定的通讯协议配置信息,传输极性信息至移位寄存器;

移位寄存器,接收极性矫正电路极性信息,输出并行数据至输入寄存器;

输入寄存器,与时序控制器相连,并接收移位寄存器内的并行数据;

计数控制电路,接收采样点生成电路的脉冲信号及指定的通讯协议配置信息中的接收位数数据,发出时序控制的启动信号至时序控制电路;

时序控制电路,接收计数控制电路控制信息,传递配置信息至输入寄存器和状态寄存器,同时输出时序控制信息至时序控制器;

可编程状态机,包括三元内容寻址存储器阵列、优先处理电路及双口RAM阵列,其中三元内容寻址存储器阵列与时序控制电路相连,接收输入寄存器的并行数据与期待的协议信息,将合法数据经优先级处理电路输给双口RAM阵列;优先级处理电路的输入分别连接时序控制电路及三元内容寻址存储器阵列的输出端,优先级处理电路的输出直接连接双口RAM阵列的“字”线;双口RAM阵列接收外部设备主处理器输入的可编程的、对应于三元内容寻址存储器阵列的状态信号和用于数据通道电路的控制信号,与时序控制器相连的同时将优先级管理电路输入的来自三元内容寻址存储器阵列的合法数据作为“字”线输入,双口RAM阵列的“位”线输出下一次匹配运算需要使用的、三元内容寻址存储器阵列的、协议信息所在的区域状态信息和下一次需要的接收位数数据,作为状态寄存数据和输出状态信息;

状态寄存器,与时序控制器相连,将双口RAM阵列中状态信息反馈输出到三元内容寻址存储器阵列;

输出寄存器,接收双口RAM阵列的输出状态信息,即指定的通讯协议配置信息,输出分四路:一路作为接收位数数据至计数控制电路,一路接位同步电路,一路至极性矫正电路,另一路至采样点生成电路。

2.按权利要求1所述三元内容寻址存储器通用现场总线接收机,其特征在于:所述三元内容寻址存储器阵列采用“或非”型或者“与非”型双三元内容寻址存储器阵列。

3.按权利要求2所述三元内容寻址存储器通用现场总线接收机,其特征在于:所述双三元内容寻址存储器结构为:8个MOS管先两两串联分成四组,再将所述四组MOS晶体管并联起来构成比较电路;4个SRAM单元的存储数据端分别接至四组串联的MOS管中的一个MOS管栅极,输入信号分别接至所述四组串联的MOS管中的另一个MOS管的栅极;四组串联的MOS管中的一个MOS管的空闲端作为输出空闲端,另一个MOS管的空闲端的空闲端作为输入空闲端;4个SRAM单元的输出为期待的输入数据。

4.按权利要求2所述三元内容寻址存储器通用现场总线接收机,其特征在于:所述双三元内容寻址存储器阵列结构为:双三元内容寻址存储器和2-4位译码器译码组合而成,其中两个相邻的输入信号经过2-4位译码器译码产生4条输出线作为一列单元的搜索线;每一行的双三元内容寻址存储器通过匹配线串联。

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