[发明专利]DDC接口电路无效
申请号: | 200810302656.3 | 申请日: | 2008-07-08 |
公开(公告)号: | CN101625846A | 公开(公告)日: | 2010-01-13 |
发明(设计)人: | 胡可友 | 申请(专利权)人: | 鸿富锦精密工业(深圳)有限公司;鸿海精密工业股份有限公司 |
主分类号: | G09G5/00 | 分类号: | G09G5/00;G06F13/38;H03K19/0175 |
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地址: | 518109广东省深圳市*** | 国省代码: | 广东;44 |
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摘要: | |||
搜索关键词: | ddc 接口 电路 | ||
技术领域
本发明涉及一种接口电路,特别涉及一种主板上的显示数据通道(DisplayData Channel,DDC)接口电路。
背景技术
对于视频显示设备,DDC用来在输出视频信号的设备(如主机)与视频显示设备(如电脑显示器)之间交换显示器的属性信息(最优分辨率等),从而使主机能够根据显示器的属性自动地执行设置。在DDC中,以EDID(Extended Display IDentification,扩展显示标识)数据的格式化的形式交换显示器的属性信息。由于EDID数据与显示器的分辨率有关,所以当主机无法获取显示器的EDID数据时会造成显示器黑屏。现有技术中,常常是因为显示器发送给主板的ACK(Automatic Color Killer,自动消色)信号的电平太高,超过规定的低电平范围而被主板判定为无效电平,从而导致主板无法读取显示器的EDID数据。
发明内容
鉴于上述内容,有必要提供一种DDC接口电路,可确保主板能够获取显示器的EDID数据。
一种显示数据通道接口电路,包括一第一NMOS场效应管、一第二NMOS场效应管、一第一电阻、一第二电阻、一第三电阻、一第四电阻以及一第五电阻,所述第一NMOS场效应管的栅极通过所述第一电阻接一3.3V系统电压,其源极接主板北桥的数据显示通道时钟引脚,其漏极通过所述第二电阻接一5V系统电压,并通过所述第四电阻接主板上的视频图形阵列接口电路的串行时钟引脚;所述第二NMOS场效应管的栅极通过所述第一电阻接所述3.3V系统电压,其源极接主板北桥的数据显示通道数据引脚,其漏极通过所述第三电阻接所述5V系统电压,并通过所述第五电阻接所述视频图形阵列接口电路的串行数据引脚,所述视频图形阵列接口电路还与一显示器的自动消色电路相连以接收一自动消色信号并通过所述显示数据通道接口电路将其传输给所述主板北桥。
相较于现有技术,上述DDC接口电路通过将3.3V系统电压和5V系统电压通过电阻分压后提供给连接在主板北桥和显示器之间的两个NMOS场效应管,使其正常导通,确保显示器发送的自动消色信号能够达到主板,从而使主板获取显示器的EDID数据。
附图说明
下面参照附图结合具体实施方式对本发明作进一步的描述。
图1为本发明DDC接口电路的较佳实施方式的电路图。
具体实施方式
请参照图1,本发明DDC接口电路的较佳实施方式包括两NMOS场效应管Q1和Q2、以及五电阻R1、R2、R3、R4和R5。
所述NMOS场效应管Q1的栅极通过所述电阻R1接一3.3V_SYS(3.3VSystem,3.3V系统)电压,其源极接一北桥100的DDC_CLK(Display DataChannel Clock,数据显示通道时钟)引脚,其漏极通过所述电阻R2接一5V_SYS(5V System,5V系统)电压,并通过所述电阻R4接主板上的VGA(Video Graphics Array,视频图形阵列)接口电路300的SCL(Serial Clock,串行时钟)引脚;所述NMOS场效应管Q2的栅极通过所述电阻Rl接所述3.3V_SYS电压,其源极接所述北桥100的DDC_DATA(Display Data ChannelData,数据显示通道数据)引脚,其漏极通过所述电阻R3接所述5V_SYS电压,并通过所述电阻R5接所述VGA接口电路300的SDA(Serial Data,串行数据)引脚,所述VGA接口电路300还连接一显示器400的ACK(AutomaticColor Killer,自动消色)电路10以接收一ACK信号并将其传输给所述DDC接口电路200。
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