[发明专利]并联型解码器无效
| 申请号: | 200810133956.3 | 申请日: | 2008-07-18 | 
| 公开(公告)号: | CN101383675A | 公开(公告)日: | 2009-03-11 | 
| 发明(设计)人: | 岩村英志;鹿嶋正幸 | 申请(专利权)人: | 冲电气工业株式会社 | 
| 主分类号: | H04J14/00 | 分类号: | H04J14/00;H03H17/02 | 
| 代理公司: | 北京三友知识产权代理有限公司 | 代理人: | 黄纶伟 | 
| 地址: | 日本*** | 国省代码: | 日本;JP | 
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| 摘要: | |||
| 搜索关键词: | 并联 解码器 | ||
1.一种并联型解码器,其特征在于,所述并联型解码器具有:
控制信号生成部,其从由外部输入的、对数据信号进行编码而得到 的输入电信号提取频率与码扩散率相当的时钟信号,生成频率为该时钟 信号频率的1/2的1/2分频时钟信号、以及频率与所述数据信号的基率相 当的基率时钟信号并输出;以及
解码部,其被输入所述输入电信号,将该输入电信号解码,生成解 码信号并输出,
其中,所述码扩散率是指对构成码的1个码片分配的时间的倒数, 所述基率是指分配给要传送的所述数据信号的1个比特的时间的倒数,
所述解码部包括:
分路器,其将所述输入电信号二分支成第1输入电信号和第2输入 电信号;
输入电信号延迟电路,其被输入所述第1输入电信号,对该第1输 入电信号给予与对构成码的1个码片分配的时间相等的时间延迟,生成 延迟第1输入电信号并输出;
第1匹配滤波器,其被输入该延迟第1输入电信号,与所述1/2分 频时钟信号同步地生成第1相关信号并输出;
第2匹配滤波器,其被输入所述第2输入电信号,与所述1/2分频 时钟信号同步地生成第2相关信号并输出;以及
判断部,其生成所述第1相关信号和所述第2相关信号的合成信号, 与所述基率时钟信号同步地进行阈值判断处理,作为将所述合成信号的 强度大于阈值电平的时间带设为电平1、将所述合成信号的强度小于阈值 电平的时间带设为电平0的解码信号输出。
2.一种并联型解码器,其特征在于,所述并联型解码器具有:
控制信号生成部,其从由外部输入的、对数据信号进行编码而得到 的输入电信号提取频率与码扩散率相当的时钟信号,生成并输出频率为 该时钟信号频率的1/2的1/2分频时钟信号、将该1/2分频时钟信号的相 位反转而得到的反相1/2分频时钟信号、以及频率与所述数据信号的基率 相当的基率时钟信号;以及
解码部,其被输入所述输入电信号,将该输入电信号解码,生成解 码信号并输出,
其中,所述码扩散率是指对构成码的1个码片分配的时间的倒数, 所述基率是指分配给要传送的所述数据信号的1个比特的时间的倒数,
所述解码部包括:
分路器,其将所述输入电信号二分支成第1输入电信号和第2输入 电信号;
第1匹配滤波器,其被输入所述第1输入电信号,与所述1/2分频 时钟信号同步地生成第1相关信号并输出;
第2匹配滤波器,其被输入所述第2输入电信号,与所述反相1/2 分频时钟信号同步地生成第2相关信号并输出;以及
判断部,其生成所述第1相关信号和所述第2相关信号的合成信号, 与所述基率时钟信号同步地进行阈值判断处理,作为将所述合成信号的 强度大于阈值电平的时间带设为电平1、将所述合成信号的强度小于阈值 电平的时间带设为电平0的解码信号输出。
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