[发明专利]告警信息处理方法有效
申请号: | 200810127562.7 | 申请日: | 2008-06-27 |
公开(公告)号: | CN101616020A | 公开(公告)日: | 2009-12-30 |
发明(设计)人: | 桂国才;陆荣飞 | 申请(专利权)人: | 中兴通讯股份有限公司 |
主分类号: | H04L12/24 | 分类号: | H04L12/24;H04W24/04;H04M3/22 |
代理公司: | 北京康信知识产权代理有限责任公司 | 代理人: | 尚志峰;吴孟秋 |
地址: | 518057广东省深圳市南*** | 国省代码: | 广东;44 |
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摘要: | |||
搜索关键词: | 告警 信息处理 方法 | ||
技术领域
本发明涉及通信领域,并且特别地,涉及一种告警信息处理方法。
背景技术
在传输设备中,当传送平面(为信息传输提供物理通道的抽象系统)出现故障时,通常在交叉单元将告警信息提取出来,再传送到控制平面(控制传输网络的抽象系统)。根据送上来的复用段、通道等告警,控制平面能够自动进行网络连接的恢复工作,以保证整个网络正常工作。
具体的实现方法如下:交叉单元将提取出来的传送平面告警信息通过某种通讯方式传送到网元主控单元,主控单元先将接收到的第一帧告警数据保存起来,当收完第二帧数据时,将前后两帧告警数据进行比较,如果数据没变化,则不用执行其它操作;如果数据有变化,则根据发生了变化的数据位执行相应的操作。
这种实现方法的问题在于:每接收完一帧数据后,不论数据相对前一帧有无变化,软件都必须将它们进行比较处理,而告警数据是连续不断传送过来的,因此会占用大量的CPU资源,影响程序中其他任务的运行效率,也会影响告警的响应速度。
目前,针对上述告警信息处理速度慢、资源利用率低的问题,目前尚未提出有效的解决方案。
发明内容
考虑到上述问题而做出本发明,为此,本发明的主要目的在于提供一种告警信息处理方案,以解决相关技术中告警信息处理速度慢、资源利用率低的问题。
根据本发明的实施例,提供了一种告警信息处理方法。
该方法包括:将传输设备的有效的第一告警信息帧发送至现场可编程门阵列;在接收第一告警信息帧之后的第二告警信息帧时,现场可编程门阵列将接收的每个字节的数据与第一告警信息帧中相应位置的数据进行比较,直至对前后两个信息帧中的每个数据比较完毕;根据接收的每个字节的比较结果判断第二告警信息帧的有效性。
其中,在将第一告警信息帧传输至现场可编程门阵列之后,该方法可进一步包括:现场可编程门阵列将第一告警信息帧锁存在现场可编程门阵列的随机接入存储器中;现场可编程门阵列通知CPU将锁存的第一告警信息帧存储至内存中。
并且,在对接收的每个字节进行比较前,现场可编程门阵列读取随机接入存储器中锁存的第一告警信息帧,并将接收的第二告警信息帧的每个字节与读取的第一告警信息帧中的相应字节进行比较。
具体地,判断第二告警信息帧的有效性的处理具体为:
对于接收的每个字节,以预定方式将其与第一告警信息帧中的相应字节进行比较,确定接收的每个字节所对应的通道的告警信息是否有效并对告警信息有效的通道的告警标志位进行置为有效位的操作;
在第二告警信息帧接收并处理完成后,如果所有通道的告警标志位不全被置为表示信息无效,则将帧告警标志置为表示当前接收的一帧告警信息中存在有效信息,否则,将帧告警标志置为表示当前接收的一帧告警信息中不存在有效信息。
并且,还包括:CPU查询帧告警标志位,并根据查询结果进行相应的操作;或者,CPU接收外部中断,其中该外部中断用于通知该CPU读取有效的告警数据。
此外,以预定方式确定接收的每个字节所对应的通道的告警信息是否有效的处理具体包括:
当出现的复用段失效告警在第一告警信息帧和第二告警信息帧中均为无告警的情况下,如果产生告警的端口的管理单元的告警发生变化,则将相应通道的告警标志位设置为告警信息有效;
当出现的复用段失效告警在第一告警信息帧中为无告警、在第二告警信息帧中为有告警的情况下,将相应通道的告警标志位设置为告警信息有效;
当出现的复用段失效告警在第一告警信息帧和第二告警信息帧中均为有告警的情况下,将相应通道的告警标志位设置为告警信息无效;
当出现的复用段失效告警在第一告警信息帧中为有告警、在第二告警信息帧中为无告警的情况下,将相应通道的告警标志位设置为告警信息有效。
此外,现场可编程门阵列通知CPU将锁存的第一告警信息帧存储至内存中的方式为以下至少之一:外部中断方式、查询方式。
通过本发明的上述技术方案,能够对告警信息进行压制处理,从而减轻控制平面的负担,提高了告警的处理更速度和效率,保证设备的业务倒换质量。
附图说明
此处所说明的附图用来提供对本发明的进一步理解,构成本申请的一部分,本发明的示意性实施例及其说明用于解释本发明,并不构成对本发明的不当限定。在附图中:
图1是根据本发明实施例的告警信息处理方法的流程图;
图2是根据本发明实施例的告警信息处理方法的实现过程中FPGA的结构及连接关系的示意图;
图3是根据本发明实施例的告警信息处理方法中中断处理的流程图。
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