[实用新型]一种DSP与绝对式编码器通讯及解码的装置无效
| 申请号： | 200720051285.7 | 申请日： | 2007-05-10 |
| 公开（公告）号： | CN201063104Y | 公开（公告）日： | 2008-05-21 |
| 发明（设计）人： | 廖文高;麻文兴 | 申请（专利权）人： | 广州数控设备有限公司 |
| 主分类号： | G05B19/042 | 分类号： | G05B19/042;G05D3/00 |
| 代理公司： | 广州三环专利代理有限公司 | 代理人： | 郝传鑫 |
| 地址： | 510165广东省*** | 国省代码： | 广东;44 |
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| 摘要： | |||
| 搜索关键词： | 一种 dsp 绝对 编码器 通讯 解码 装置 | ||
1.一种DSP与绝对式编码器通讯及解码的装置，其包括：采集外部交流伺服电机数据的绝对式编码器、与该绝对式编码器电连接并将该绝对式编码器采集的数据转换为串行数字信号的接口电路、与该接口电路电连接并将所述串行数字信号转换为并行数据的可编程逻辑器件、与该可编程逻辑器件电连接并对该并行数据进行解码的DSP。
2.如权利要求1所述的DSP与绝对式编码器通讯及解码的装置，其特征在于还包括连接于可编程逻辑器件与接口电路之间的电平转换电路。
3.如权利要求1所述的DSP与绝对式编码器通讯及解码的装置，其特征在于：所述可编程逻辑器件包括：接收从该DSP发来的控制信号并对该控制信号进行译码的控制信号接收器，对译码后的控制信号进行逻辑控制运算并发出控制信号的逻辑控制器、根据逻辑控制器发出的信号与绝对式编码器进行通讯的数据收发器、将数据收发器中的数据转换为并行数据并将该并行数据传送给DSP的数据转换器。
4.如权利要求3所述的DSP与绝对式编码器通讯及解码的装置，其特征在于：所述可编程逻辑器件还包括时钟、将时钟频率分频的分频器以及给收发数据器提供波特率的波特率发生器。
5.如权利要求4所述的DSP与绝对式编码器通讯及解码的装置，其特征在于：所述分频器向逻辑控制器输入时钟以及向波特率发生器输入时钟。
6.如权利要求1所述的DSP与绝对式编码器通讯及解码的装置，其特征在于：所述接口电路为差分接口电路，该差分接口电路包括第一差分放大器，所述绝对式编码器中包括第二差分放大器，第一差分放大器与第二差分放大器相连。
7.如权利要求1所述的DSP与绝对式编码器通讯及解码的装置，其特征在于：所述差分接口电路采用串行的数据传输方式。
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