[发明专利]移位寄存器有效
申请号: | 200710308351.9 | 申请日: | 2007-12-29 |
公开(公告)号: | CN101266763A | 公开(公告)日: | 2008-09-17 |
发明(设计)人: | 张容豪 | 申请(专利权)人: | LG.菲力浦LCD株式会社 |
主分类号: | G09G3/36 | 分类号: | G09G3/36;G11C19/00;G02F1/133 |
代理公司: | 北京律诚同业知识产权代理有限公司 | 代理人: | 徐金国;梁挥 |
地址: | 韩国*** | 国省代码: | 韩国;KR |
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摘要: | |||
搜索关键词: | 移位寄存器 | ||
本发明要求享有2007年03月12日提交的韩国专利申请No.2007-23835的优先权,在此引入其全部内容作为参考。
技术领域
本发明涉及一种液晶显示(LCD)器件的移位寄存器,特别是涉及一种能够通过减小放电电压源线上的负载而防止器件误操作并能够减小各级(stage)尺寸的移位寄存器。
背景技术
通常,液晶显示(LCD)器件通过利用施加的电场控制液晶的透光率来显示图像。为此,LCD器件提供有包括多个以矩阵结构设置的像素区域的液晶面板以及驱动液晶面板的驱动电路。
液晶面板包括多条栅线和多条数据线,其中每条栅线形成为与每条数据线正交,从而定义多个像素区域。此外,液晶面板包括像素电极和公共电极,以分别为各个像素区域施加电场。此时,响应于由移位寄存器产生的扫描脉冲,顺序驱动栅线。
图1示出相关技术的移位寄存器中的一级。如图1所示,相关技术中的移位寄存器包括多个级100。多个级100串联。每级提供有来自时钟传输线的时钟脉冲,并顺序输出扫描脉冲。每级包括多个节点;控制节点的信号状态的节点控制器;以及连接到节点的输出单元,以响应节点的信号状态输出扫描脉冲。为了保持节点为放电状态,相关技术的移位寄存器使用对应于恒压的放电电压源。
然而,相关技术的移位寄存器具有以下缺点。
当放电电压源提供给包括在每级内的节点控制器与输出单元时,在用于传输放电电压源的放电电压源线上存在大的负载。由于包括在每级内的节点没有适当地放电,相关技术的移位寄存器具有误操作的问题。
而且,相关技术的级提供有至少两个节点和多个开关器件以控制节点,使得移位寄存器尺寸增大。移位寄存器的大尺寸可能导致在液晶面板中形成移位寄存器的技术上的局限性。
发明内容
因此,本发明涉及一种基本上消除了由于相关技术的局限性和缺点的一个或多个问题的移位寄存器。
本发明的一个目的是提供一种能够通过减小放电电压源线上的负载防止误操作并可以减小级的尺寸的移位寄存器。
本发明附加的优点、目标和特征将在随后的描述中部分地加以阐述,并且部分地,在阅读了下面的内容后对本领域技术人员来说是显而易见的,或者可以通过实践本发明而获得教导。本发明的这些目的和优点将通过说明书及其权利要求书以及附图中所特别指出的结构而实现和获得。
为了实现这些目的和其他优点,根据在此具体化并宽泛地描述的本发明的目的,一种移位寄存器包括多个级用于通过各级的输出端子顺序输出扫描脉冲,其中每一级包括上拉开关单元,其中基于节点的信号状态控制该上拉开关单元,并且该上拉开关单元连接在输出端子和用于传输具有顺序相差的时钟脉冲的多条时钟传输线中任意一条时钟传输线之间;以及节点控制器,控制节点的信号状态并利用来自多条时钟传输线中任意一条时钟传输线的时钟脉冲使节点放电;其中,当前级的所述节点控制器包括:第一开关单元,由起始脉冲或来自前级的扫描脉冲控制,并连接在节点和充电电压源传输线之间,所述充电电压源传输线用于传输充电电压源;以及第二开关单元,由来自后级的扫描脉冲控制,并连接在所述节点和多条时钟传输线中任意一条时钟传输线之间,其中第二开关单元在连接到第二开关单元的时钟传输线的时钟脉冲的非激活状态被接通,并且第二开关单元和上拉开关单元被连接到相同的时钟传输线。
要理解,本发明前面一般性的描述和后面具体的描述都是示例性和解释性的,本发明意在对如权利要求书所述的本发明实施例提供进一步的解释。
附图说明
本发明所包含的附图用来进一步理解本发明并且被结合来构成本申请的一部分,该附图图示了本发明的实施例并且与说明书一起来解释本发明的原 理。在附图中:
图1示出了包括在相关技术的移位寄存器中的一级;
图2示出了根据本发明的优选实施例的移位寄存器;
图3示出了提供到图2的每级或从图2的每级输出的多个信号的时序图;
图4示出了图2的级的第一电路结构;
图5示出了图2的级的第二电路结构;
图6示出图2的级的第三电路结构;
图7示出图2的级的第四电路结构;
图8示出图2的级的第五电路结构;
图9示出图2的级的第六电路结构;
图10示出图2的级的第七电路结构;
图11示出图2的级的第八电路结构;
图12示出图2的级的第九电路结构;
图13示出图2的级的第十电路结构;
图14示出图2的第一至第三级的电路结构;以及
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