[发明专利]平台资源的服务质量实现有效
| 申请号: | 200710194428.4 | 申请日: | 2007-09-24 |
| 公开(公告)号: | CN101196834A | 公开(公告)日: | 2008-06-11 |
| 发明(设计)人: | R·伊利卡尔;R·耶尔;L·普蒂耶达斯;D·纽厄尔;L·赵;S·马金尼 | 申请(专利权)人: | 英特尔公司 |
| 主分类号: | G06F9/50 | 分类号: | G06F9/50;H04L12/24 |
| 代理公司: | 中国专利代理(香港)有限公司 | 代理人: | 曾祥夌;魏军 |
| 地址: | 美国加利*** | 国省代码: | 美国;US |
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| 摘要: | |||
| 搜索关键词: | 平台 资源 服务质量 实现 | ||
技术领域
本发明涉及平台资源的服务质量。
背景技术
随着多核多线程处理器变得常见,在计算机工业中,存在一种强烈的需求,要求允许操作系统和应用程序对平台中的可用资源具有更好的控制。由于更多的核心和计算能力加到了计算机平台,运行在这些核心上的应用程序共享的其余平台资源,需要被很好地管理以便创建一个平衡的系统。现今,使用任务优先级寄存器(TPR)将向运行在中央处理器上的应用程序提供的计算机系统服务的差异等级限于处理器核心。当应用软件经历不同的任务优先级等级时,软件设置该寄存器以标志该处理器的当前优先级等级。该信息用来避免处理器被更低优先级的事件中断。
处理器硬件保证在核心内的优先级执行,并且本质上是管理可用计算机资源的机制。但是,当其涉及在核心之外的资源时,当前并没有机制针对软件将服务级别需求传到潜在的平台级别服务质量(QoS)机制。处理器和平台资源的细粒度管理的这种缺乏可能随着更多虚拟技术的实现而恶化,并且计算机用户通过在同一台机器上运行多种完全不同的应用程序来巩固他们的服务器。针对于此,在组件以及平台级别上,开发在处理器核心之外的QoS机制,以提供更好的管理可用资源的方法。但是没有合适的机制将这些能力展示给操作系统和应用程序,可能无法实现平台QoS的全部潜力。
发明内容
根据本发明的一个方面,提供一种方法,包括:为除中央处理器核心以外与运行在计算机系统上的任务相关的一个或多个计算机系统平台资源,设置服务质量(QoS)优先级等级值;以及确定是否将根据QoS优先级等级设置,将一个或多个计算机系统平台资源分配给所述任务。
根据本发明的另一方面,提供一种计算机可读介质,其上包含有指令,所述指令在由计算机执行时使所述计算机执行包括如下步骤的方法:为除中央处理器核心以外与运行在计算机系统上的任务相关的一个或多个计算机系统平台资源,设置服务质量(QoS)优先级等级值;以及确定是否将根据QoS优先级等级设置,将所述一个或多个计算机系统平台资源分配给所述任务。
根据本发明的又一方面,提供一种系统,包括:互连;中央处理器,耦合到所述互连;输入/输出(I/O)设备,耦合到所述互连;存储器,耦合到所述互连,所述存储器适合于存储指令,所述指令在由所述处理器运行时执行如下操作:为除所述中央处理器核心以外与运行在计算机系统上的任务相关的一个或多个系统资源,设置服务质量(QoS)优先级等级值;以及确定是否将根据QoS优先级等级设置,将所述一个或多个计算机系统平台资源分配给所述任务。
附图说明
本发明通过例子方式来图解说明,并且不受附图中图的限制,附图中类似的参考标记表明类似的部件,并且其中:
图1是可以用在本发明实施例的计算机系统的框图。
图2描述使用现有TPR来设置平台资源优先级等级的平台上的平台级QoS机制的一个实施例。
图3描述使用PQR来设置平台资源优先级等级的平台上的平台级QoS机制的实施例的详细型式。
图4图解说明图2所示的平台级QoS机制使用的现有TPR和CR8的实现的一个实施例。
图5图解说明图3所示的在其中实现PQR的平台级QoS机制使用的CR8的实现的一个实施例。
图6描述使用平台资源优先化进程的可用位的存储器页表条目(PTE)格式的一个实施例。
图7是基于QoS优先级等级分配计算机平台资源的过程的一个实施例的流程图。
图8是用QoS优先级等级值来标记存储器要求存取在处理器核心之外的平台资源的请求的过程的一个实施例的流程图。
图9是用平台资源QoS优先级等级值来填充存储器页表条目的过程的一个实施例的流程图。
具体实施方式
描述了为平台资源实现服务质量优先级等级控制的方法、系统和计算机可读介质的实施例。在以下说明中,阐述众多具体细节。然而,应当清楚,可以脱离这些具体细节而实现实施例。在另一些例子中,为了避免模糊本发明,未详细讨论众所周知的元件、规范和协议。
图1是可以用于本发明实施例的计算机系统的框图。计算机系统包含处理器-存储器互连100,用于在耦合到互连100的不同代理例如处理器、桥接器、存储器设备等之间通信。处理器-存储器互连100包括用于发送判优、地址、数据和控制信息的具体互连线(未示出)。在一个实施例中,中央处理器102可以耦合到处理器-存储器互连100。在另一个实施例中,可以有耦合到处理器-存储器互连的多个中央处理器(在该图中未示出多个处理器)。
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