[发明专利]降低数字放大器中弹出式噪声的电路和方法无效
| 申请号: | 200710180267.3 | 申请日: | 2007-10-16 |
| 公开(公告)号: | CN101166015A | 公开(公告)日: | 2008-04-23 |
| 发明(设计)人: | 李遂炯;廉旺燮;曹勇振;李仁福 | 申请(专利权)人: | 三星电子株式会社 |
| 主分类号: | H03F3/217 | 分类号: | H03F3/217;H03F1/26;H03K17/687;H03K5/01;H03K19/0185 |
| 代理公司: | 北京市柳沈律师事务所 | 代理人: | 邵亚丽 |
| 地址: | 韩国*** | 国省代码: | 韩国;KR |
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| 摘要: | |||
| 搜索关键词: | 降低 数字 放大器 弹出式 噪声 电路 方法 | ||
1.一种用在数字放大器中的电路,包括:
开关单元,其耦合到数字放大器的输出节点和参考节点之间的输出负载,该开关单元被配置为通过响应于开关信号在输出节点和参考节点之间形成传导通路,来控制流经输出负载的电流;和
开关信号发生器,其被配置为响应于指示开电或关电的开关控制信号而产生开关信号。
2.如权利要求1所述的电路,其中,在所述数字放大器正常操作期间,所述参考节点的电压保持为第一电源电压和第二电源电压的平均值。
3.如权利要求2所述的电路,其中,在所述数字放大器的静音操作期间,所述输出节点的电压保持为所述参考节点的电压,并且在该数字放大器正常操作期间,该输出节点的电压在所述第一电源电压和第二电源电压之间变化。
4.如权利要求1所述的电路,其中,所述开关单元包括耦合在所述输出节点和参考节点之间的开关,所述开关被配置为响应于所述开关信号操作。
5.如权利要求4所述的电路,其中,所述开关包括NMOS晶体管,并且所述开关信号发生器被配置为当所述数字放大器开电或关电时输出逻辑高的开关信号给该NMOS晶体管的栅极。
6.如权利要求1所述的电路,还包括耦合在所述开关信号发生器和所述开关单元之间的平滑单元,所述平滑单元被配置为延长输出到该开关单元的开关信号的转变时间。
7.如权利要求6所述的电路,其中,所述平滑单元包括RC电路,该RC电路包括电阻器和电容器。
8.如权利要求1所述的电路,其中,所述开关单元包括多个相互并联耦合在所述输出节点和参考节点之间的NMOS晶体管,每个所述NMOS晶体管的栅极接收对应的开关信号。
9.如权利要求8所述的电路,还包括耦合在所述开关信号发生器和所述开关单元之间的平滑单元,所述平滑单元被配置为延长输出到该开关单元的开关信号的转变时间。
10.如权利要求9所述的电路,其中,所述平滑单元包括多个分别耦合到所述NMOS晶体管的栅极的RC电路,每个RC电路包括电阻器和电容器。
11.如权利要求8所述的电路,其中,所述开关信号发生器被配置为响应于所述开关控制信号产生多个开关信号,所述多个开关信号被分别输出到每个所述NMOS晶体管的栅极,所述多个开关信号顺序转变到逻辑高。
12.如权利要求11所述的电路,其中,所述开关信号发生器包括多个延迟缓冲器,所述延迟缓冲器被配置为顺序延迟所述开关控制信号,以产生顺序转变到逻辑高的多个开关信号。
13.如权利要求11所述的电路,其中,所述开关信号发生器包括多个触发器,所述触发器被配置为响应于所述开关控制信号和时钟信号产生所述多个开关信号,以使得所述多个开关信号顺序地在该时钟信号的一个时钟周期内转变到逻辑高。
14.如权利要求8所述的电路,其中,所述NMOS晶体管具有不同的导通电阻。
15.如权利要求14所述的电路,其中,具有较高导通电阻的NMOS晶体管在具有较低导通电阻的NMOS晶体管导通之前导通。
16.一种数字放大器,用于驱动耦合在输出节点和参考节点之间的输出负载,该数字放大器包括:
D类驱动电路,其被配置为基于第一电源电压和第二电源电压放大脉宽调制(PWM)信号,并输出放大后的PWM信号;
低通滤波器,其被配置为将该放大后的PWM信号转换为模拟信号,并输出该模拟信号到输出节点;
参考电压发生器,其被配置为向参考节点输出参考电压,所述参考电压对应于所述第一电源电压和第二电源电压的平均值;和
弹出式噪声降低电路,其被配置为通过响应于指示开电或关电的开关控制信号在输出节点和参考节点之间形成传导通路,来控制流经输出负载的电流。
17.如权利要求16所述的数字放大器,其中,在所述数字放大器静音操作期间,所述输出节点的电压保持在所述参考电压,并且在该数字放大器正常操作期间,输出节点的电压在所述第一电源电压和第二电源电压之间变化。
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