[发明专利]电梯控制装置无效
| 申请号: | 200710136185.9 | 申请日: | 2007-07-20 | 
| 公开(公告)号: | CN101108706A | 公开(公告)日: | 2008-01-23 | 
| 发明(设计)人: | 文屋雅弘 | 申请(专利权)人: | 东芝电梯株式会社 | 
| 主分类号: | B66B1/14 | 分类号: | B66B1/14 | 
| 代理公司: | 北京市中咨律师事务所 | 代理人: | 段承恩;杨光军 | 
| 地址: | 日本*** | 国省代码: | 日本;JP | 
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| 摘要: | |||
| 搜索关键词: | 电梯 控制 装置 | ||
技术领域
本发明涉及由根据预定的控制动作程序以及各种设定数据对设置在楼宇等的建筑物的电梯的动作进行控制的微型计算机所构成的电梯控制装置。
背景技术
在由设置在楼宇等的建筑物中的一台或多台电梯构成的电梯系统中,通过乘梯者对设置在各层的电梯间的站台呼叫登记装置的按钮操作来登记站台呼叫。当站台呼叫被登记时,将该站台呼叫分配给上述多台电梯之中的例如响应时间最短的一台电梯。其结果是,该电梯的轿厢移动至站台呼叫被登记的楼层,打开电梯门。乘梯者进入该电梯的轿厢,通过设置在轿厢内的轿厢呼叫登记装置的按钮指定要去的楼层,则轿厢门关闭,电梯的轿厢开始向指定楼层移动。
组装入上述电梯系统的、例如由计算机构成的电梯控制装置,根据预定的控制动作程序、各种设定数据,对上述电梯的基本动作进行控制。
另一方面,伴随着电子技术的发展,如日本专利公开公报(特开2004-210506号)所记载的那样,上述近年的电梯控制装置是由微型计算机(Microcomputer)构成的。而且,在该微型计算机内,在印刷布线基板上安装有CPU(Central Processor Unit)、ROM(Read Only Memory)、RAM(Random Access Memory)、各种接口(Interface)、各种输入输出电路等。
另外,在由该微型计算机构成的电梯控制装置的ROM中写入有所述控制动作程序。而且,CPU用在自身内事先硬件写入的访问用程序,将写入该ROM的控制动作程序、各种设定数据顺次读出并执行。而且,近年来,存在控制动作程序的存储场所由以往的ROM向快速ROM(FlushRead Only Memory)变化的倾向。
图7是表示由上述微型计算机构成的电梯控制装置的概略构成的示意图。
相对于由地址总线(Address bus)1、数据总线(Data bus)2、多条控制总线(Control bus)3a、3b构成的总线线路(Bus line)4,连接有CPU 5、总线控制部(Bus Controller)6、SRAM(Static Random AccessMemory)7、快速ROM 8、EEPROM(Electrical Erasable ProgrammableRead Only Memory)9、输入输出电路10、串行输入输出电路11等。
为了使数据(Data)在各总线1、2、3a、3b中不发生线路冲突,总线控制部6控制上述各部分对总线线路4的数据输出。在SRAM 7内,存储有在控制各电梯的动作时必须的各种可变数据。该可变数据,包括例如各电梯的当前位置、各站台呼叫登记装置所登记的未响应的站台呼叫、各轿厢呼叫登记装置所登记的未响应的轿厢呼叫等。
在快速ROM 8内存储有上述的控制动作程序、电梯的控制所必须的各种参数等的各种设定数据。而且,在EEPROM 9内设定有其他的数据。
从输入输出电路10向对应于使各电梯的轿厢实际上下移动的卷扬机的驱动电路施加驱动信号,而且,在该输入输出电路10输入表示电梯状态的信号。另外,在串行输入输出电路11,将来自所述各楼层的站台呼叫登记装置、各电梯的轿厢呼叫登记装置的站台呼叫、轿厢呼叫作为串行信号输入。而且,在该串行输入输出电路11,通过通信线路与电梯管理公司的监视中心相连接。
众所周知,快速ROM 8是能够电子改写存储内容的ROM,CPU 5除了能够以一个字节为单位将数据(或者命令)读出、写入、删除之外,还能够如图8所示以段12为单位将数据(或者命令)读出、写入、删除。各段12的段尺寸(地址宽度)BA,能够根据该快速ROM 8的规格任意地设定。
在该电梯控制装置中,以实施电梯控制的情况为例,对CPU 5进行说明。另外,通常,微型计算机的CPU,根据自身内事先设定的访问用程序,按顺序指定例如ROM的各地址,顺次读出存储于该地址的程序的各命令,并执行该命令。
因此,即便在图7的电梯控制装置中,CPU 5根据自身的访问用程序对快速ROM 8进行访问时,将表示访问对象的数据或者写入位置的地址AD向地址总线1输出,将读出信号(RD)或者写入信号(WE)向控制总线3a输出。这样一来,总线控制部6根据向地址总线1输出的地址AD确定访问对象的快速ROM 8,通过控制总线3b向该快速ROM 8输出CS(芯片选择,Chip Select)信号。
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