[发明专利]有电压电平转换功能以及数据拴锁功能的多功能电路模块无效
| 申请号: | 200710127386.2 | 申请日: | 2007-07-02 |
| 公开(公告)号: | CN101339339A | 公开(公告)日: | 2009-01-07 |
| 发明(设计)人: | 刘铭晃;江伟山;韩承宪;黄启模 | 申请(专利权)人: | 奕力科技股份有限公司 |
| 主分类号: | G02F1/1362 | 分类号: | G02F1/1362;G02F1/133;G09G3/36 |
| 代理公司: | 北京市柳沈律师事务所 | 代理人: | 葛宝成;黄小临 |
| 地址: | 中国台*** | 国省代码: | 中国台湾;71 |
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| 摘要: | |||
| 搜索关键词: | 电压 电平 转换 功能 以及 数据 多功能 电路 模块 | ||
技术领域
本发明涉及一种具有电压电平转换功能以及数据拴锁功能的多功能电路模块,特别涉及一种可以经由切换多个开关元件而具有电压电平拉升功能以及数据拴锁功能的多功能电路模块。
背景技术
请参考图1,图1所绘示的是依据现有技术的一种传统的源极驱动芯片电路10与液晶显示(LCD)装置20的简化方块示意图。如图1所示,在传统的源极驱动芯片电路10中,显示数据会经过两个栓锁电路,亦即一样本寄存器(sample register)30以及一数据栓锁电路(data latch circuit)100,之后再经由一电压电平拉升电路(level shifting circuit)200传送至一数/模电压转换器(DAC)40,而转换出的模拟电压最后再由一输出缓冲器(OPAMP Buffer)50送到液晶显示装置20。
请参考图2与图3,图2所绘示的是图1中的数据栓锁电路100的电路结构示意图,以及图3所绘示的是图1中的电压电平拉升电路200的电路结构示意图。如图2以及图3所示,数据栓锁电路100包含有一第一开关元件110、一第二开关元件112、一第一反相元件120以及一第二反相元件122,并且电压电平拉升电路200,包含有一第一开关元件210、一第二开关元件212、一第三开关元件220、一第四开关元件222、一第五开关元件230以及一第六开关元件232,其中,要被栓锁的信号的电压电平由一输入端点LATCH_IN输入,然后数据栓锁电路100就会在一第一输出端点LATCH_OUT_P以及一第二输出端点LATCH_OUT_N分别产生一第一输入信号以及与该第一输入信号反相的一第二输入信号,而该第一输入信号以及该第二输入信号分别输入至电压电平拉升电路200的一第一信号接收端点LSH_IN_P以及一第二信号接收端点LSH_IN_N,接着再经由第一开关元件210、第二开关元件212、第三开关元件220、第四开关元件222、第五开关元件230以及第六开关元件232所构成的回路把被栓锁的输入信号的电压电平拉升到VDDA以及VSSA,并且在一第一信号输出端点LSH_OUT_P以及一第二信号输出端点LSH_OUT_N来进行输出信号。
然而,上述传统的电路设计很明显地会需要占用比较大的电路布局面积,因此不符合目前产业界中要求尽量降低芯片面积的趋势以及减少芯片生产成本的需求。
发明内容
有鉴于此,本发明的目的之一在于提供一种具有电压电平拉升功能以及数据拴锁功能的多功能电路模块,以解决上述的问题。
依据本发明的一方面,其揭露一种具有电压电平转换功能与数据拴锁功能的多功能电路模块,该多功能电路模块包含有:一第一电路模块、一第四开关模块以及一第五开关模块,其中,该第一电路模块又包含有:一第一开关模块、一第二开关模块以及一第三开关模块。该第一开关模块用于选择性地将该第一电压源耦接于一第一节点或是一第二节点;该第二开关模块用于选择性地将一第三节点耦接于该第一节点或是该第二节点;该第三开关模块用于接收至少一输入信号,并且选择性地将一第四节点耦接于该第一节点或是该第二节点;该第四开关模块耦接于该第四节点与一第二电压源之间,并且用来接收一第一控制信号以及依据该第一控制信号选择性地导通该第四节点与该第二电压源,其中,当该第四开关模块导通该第四节点与该第二电压源时,该第一开关模块、该第三开关模块以及该第四开关模块构成一电压电平转换电路以依据该输入信号来调整该第一节点与该第二节点中至少一个的电压电平,以进而产生至少一输出信号;以及该第五开关模块耦接于该第三节点与该第二电压源之间,并且用来接收一第二控制信号以及依据该第二控制信号选择性地导通该第三节点与该第二电压源,其中,当该第五开关模块导通该第三节点与该第二电压源时,该第一开关模块、该第二开关模块以及该第五开关模块构成一数据拴锁电路以拴锁该第一节点与该第二节点的电压电平。
附图说明
图1所绘示的是依据现有技术的一种传统的源极驱动芯片电路与液晶显示(LCD)装置的简化方块示意图。
图2所绘示的是图1中的数据栓锁电路的电路结构示意图。
图3所绘示的是图1中的电压电平拉升电路的电路结构示意图。
图4所绘示的是依据本发明的一第一实施例的多功能电路模块的简化方块示意图。
图5所绘示的是依据图4中的多功能电路模块的一实施例的电路结构示意图。
图6所绘示的是图5中第一控制信号S1以及第二控制信号S2的一实施例的时序示意图。
图7所绘示的是依据本发明的一第二实施例的多功能电路模块的简化方块示意图。
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