[发明专利]在同一衬底上集成平面和三栅器件有效
| 申请号: | 200680047661.3 | 申请日: | 2006-12-06 |
| 公开(公告)号: | CN101331603A | 公开(公告)日: | 2008-12-24 |
| 发明(设计)人: | P·L·D·常 | 申请(专利权)人: | 英特尔公司 |
| 主分类号: | H01L21/8244 | 分类号: | H01L21/8244;H01L27/11;H01L29/786 |
| 代理公司: | 中国专利代理(香港)有限公司 | 代理人: | 柯广华;张志醒 |
| 地址: | 美国加利*** | 国省代码: | 美国;US |
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| 摘要: | |||
| 搜索关键词: | 同一 衬底 集成 平面 器件 | ||
1.一种用于在同一衬底上集成不同类型晶体管的装置,包括:
在衬底上形成的第一扩散,所述第一扩散包括一对沟道,每个所述沟道将源极与漏极分开;
在所述衬底上形成的第二扩散,所述第二扩散包括将源极与漏极分开的沟道;
在所述衬底上形成的第一栅电极,其中所述第一栅电极与所述第一扩散上的所述对沟道其中之一交叠以形成通栅晶体管;以及
在所述衬底上形成的第二栅电极,其中所述第二栅电极与所述第一扩散的所述对沟道中的另一个交叠以形成下拉晶体管,并与所述第二扩散的所述沟道交叠以形成上拉晶体管,并且其中所述通栅、下拉和上拉晶体管具有至少两种不同的构造,所述至少两种不同的构造包括平面晶体管和三栅晶体管。
2.如权利要求1所述的装置,其中每个扩散具有恒定宽度。
3.如权利要求1所述的装置,其中每个栅电极具有恒定宽度。
4.如权利要求1所述的装置,其中所述通栅和上拉晶体管是平面晶体管,而所述下拉晶体管是三栅晶体管。
5.如权利要求1所述的装置,其中所述通栅晶体管是平面晶体管,而所述上拉和下拉晶体管是三栅晶体管。
6.如权利要求1所述的装置,还包括:
在所述衬底上形成的第三扩散,所述第三扩散包括将源极与漏极分开的沟道;
在所述衬底上形成的第四扩散,所述第四扩散其中包括一对沟道,每个沟道将源极与漏极分开;
在所述衬底上形成的第三栅电极,其中所述第三栅电极与所述第四扩散上的所述对沟道其中之一交叠以形成第二通栅晶体管;以及
在所述衬底上形成的第四栅电极,其中所述第四栅电极与所述第四扩散的所述对沟道中的另一个交叠以形成第二下拉晶体管,并与所述第三扩散的所述沟道交叠以形成第二上拉晶体管,并且其中所述第二通栅、下拉和上拉晶体管具有至少两种不同的构造,所述至少两种不同的构造包括平面晶体管和三栅晶体管。
7.如权利要求6所述的装置,其中所述第二通栅和第二上拉晶体管是平面晶体管,而所述第二下拉晶体管是三栅晶体管。
8.如权利要求6所述的装置,其中所述第二通栅晶体管是平面晶体管,而所述第二上拉和第二下拉晶体管是三栅晶体管。
9.如权利要求6所述的装置,其中所述第二栅电极耦合到所述第三扩散,而所述第四栅电极耦合到所述第二扩散。
10.一种用于在同一衬底上集成不同类型晶体管的工艺,包括:
在衬底上形成第一扩散,所述第一扩散包括一对沟道,每个所述沟道将源极与漏极分开;
在所述衬底上形成第二扩散,所述第二扩散包括将源极与漏极分开的沟道;
在所述衬底上形成第一栅电极,其中所述第一栅电极与所述第一扩散上的所述对沟道其中之一交叠以形成通栅晶体管;以及
在所述衬底上形成第二栅电极,其中所述第二栅电极与所述第一扩散的所述对沟道中的另一个交叠以形成下拉晶体管,并与所述第二扩散的所述沟道交叠以形成上拉晶体管,并且其中所述通栅、下拉和上拉晶体管具有至少两种不同的构造,所述至少两种不同的构造包括平面晶体管和三栅晶体管。
11.如权利要求10所述的工艺,其中每个扩散具有恒定宽度。
12.如权利要求10所述的工艺,其中每个栅电极具有恒定宽度。
13.如权利要求10所述的工艺,其中所述通栅和上拉晶体管是平面晶体管,而所述下拉晶体管是三栅晶体管。
14.如权利要求10所述的工艺,其中所述通栅晶体管是平面晶体管,而所述上拉和下拉晶体管是三栅晶体管。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
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