[实用新型]TD-SCDMA功率放大器的自动电平控制装置无效
| 申请号: | 200620157603.3 | 申请日: | 2006-11-23 |
| 公开(公告)号: | CN201008156Y | 公开(公告)日: | 2008-01-16 |
| 发明(设计)人: | 李晟;陈东进;余晓华;杜明玉 | 申请(专利权)人: | 武汉虹信通信技术有限责任公司 |
| 主分类号: | H04B7/005 | 分类号: | H04B7/005;H04J13/02 |
| 代理公司: | 湖北武汉永嘉专利代理有限公司 | 代理人: | 朱必武 |
| 地址: | 430074湖北*** | 国省代码: | 湖北;42 |
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| 摘要: | |||
| 搜索关键词: | td scdma 功率放大器 自动 电平 控制 装置 | ||
技术领域
本实用新型涉及一种用于时分同步码分多址(TD-SCDMA)功率放大器中自动电平控制的装置。
背景技术
自动电平控制是指当放大器工作于最大增益且输出为最大功率时,增加输入信号电平,放大器对输出信号电平的控制能力。传统的频分多址直放站(如GSM直放站)均采用自动电平控制来保证设备的输出为一定值,使设备不出现超负荷运行情况,但这在TD-SCDMA制式的通信系统中已经不能使用,这是因为TD-SCDMA制式是时分双工模式,上行链路信号和下行链路信号处于同一频率,通过时分复用的方式区分上行和下行。如附图1所示,每一子帧又分成长度为675us的7个常规时隙和3个特殊时隙。这三个特殊时隙分别为DwPTS(下行导频时隙)、G(保护时隙)和UpPTS(上行导频时隙)。在7个常规时隙中,Ts0总是分配给下行链路,而Ts1总是分配给上行链路。上行时隙和下行时隙之间由转换点分开。因此在TD-SCDMA制式中,TDSCDMA信号为脉冲突发信号,而并非连续信号,这就对普通放大器的自动电平控制带来一定的困难,普通放大器是通过功率放大器后级电路的功率检波反馈给前级电路的压控衰减器实现自动电平控制,对于连续信号,自动电平控制受时间影响较小,即使响应速度慢也不会影响整体信号质量,因此普通放大器可以完成自动电平控制。但是对于突发信号,当信号出现的时候由于自动电平控制不能立即做出响应,而自动电平控制开始响应后造成突发信号已经失真,没有真正起到自动电平控制的作用。
发明内容
本实用新型的目的是针对普通自动电平控制装置的弊端和TD-SCDMA信号的特殊性,提供一种TD-SCDMA功率放大器的自动电平控制装置,该装置能根据实际情况对功率进行控制,避免放大器工作于过功率等非正常状态影响信号质量,同时保护放大器不受损坏,减小维护成本,提高放大器运行中的可靠性,为移动通信运营商提供性价比更高可靠性更强的具有自动电平控制性能的功率放大器。
本实用新型的技术方案为:一种TD-SCDMA功率放大器的自动电平控制装置,其特征在于:所述的装置依次由能量检测单元101、高速模数转换AD单元102、现场可编程门阵列FPGA单元103和增益调节单元104电连接而成。
带有本装置的TD-SCDMA功率放大器工作步骤如下:
(1)开启放大单元;
(2)能量检测单元101对放大单元进行输出功率检测;
(3)高速模数转换AD单元102通过高速地AD采样分别得到TD-SCDMA各个时隙的功率值并上报现场可编程门阵列FPGA单元103;
(4)现场可编程门阵列FPGA单元103通过各个时隙功率值大小与设定控制功率值比较并计算下一帧需要调节增益的值;
(5)判断是否需要关闭放大单元关闭则返回步骤(1),否则进入下一步;
(6)增益调节单元104统一按照现场可编程门阵列FPGA单元103设定值进行增益调节,返回步骤(2)。
对于现有技术的问题“对于突发信号,当信号出现的时候由于自动电平控制不能立即做出响应,而自动电平控制开始响应后造成突发信号已经失真,没有真正起到自动电平控制的作用。”本实用新型是这样解决的:高速模数转换AD单元102通过AD采样分别得到TD-SCDMA各个时隙的功率值并上报给现场可编程门阵列FPGA单元103,现场可编程门阵列FPGA单元103根据各时隙的功率值对增益调节单元104分别进行控制,哪个时隙的功率值大于设定值就对该时隙进行衰减控制,将各时隙的突发控制在设定范围内,从而达到自动功率控制,保护放大器的目的。
本实用新型中各种数据的处理主要通过高速模数转换AD单元102和现场可编程门阵列FPGA单元103的配合,能够提供更快的响应速度,使该装置能成功的实现自动功率控制。
本实用新型具有高可靠性、简单易行的特点。
附图说明
图1为TD-SCDMA帧结构
图2为本实用新型实施例的自动电平控制装置的结构示意图
图3为图2装置在TD-SCDMA中的自动电平控制过程的原理框图
图4为图2中的能量检测101电路原理图。
图5为图2中的高速采样102电路原理图。
图6为图2中的现场可编程门阵列FPGA单元103电路原理图。
图7为图2中的增益调节单元104电路原理图。
具体实施方式
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