[发明专利]高内存使用效率的纠错处理装置有效

专利信息
申请号: 200610143798.0 申请日: 2006-11-06
公开(公告)号: CN101178922A 公开(公告)日: 2008-05-14
发明(设计)人: 杨颖智;黄界樫;王国铭 申请(专利权)人: 凌阳科技股份有限公司
主分类号: G11B20/18 分类号: G11B20/18;G06F11/00;G06F12/00
代理公司: 北京纪凯知识产权代理有限公司 代理人: 程伟;王锦阳
地址: 中国台*** 国省代码: 中国台湾;71
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摘要:
搜索关键词: 内存 使用 效率 纠错 处理 装置
【说明书】:

技术领域

发明涉及纠错处理的技术,特别涉及一种高内存使用效率的纠错处理装置及方法。

背景技术

数字多功能光盘片(Digital Versatile Disc,DVD)的数据架构是由连续的错误纠正码区块(Error Correction Code Block,ECC Block)组成。错误纠正码区块是一种具有错误纠正能力的数据区块。其中,一张DVD光盘至少含有143,500个错误纠正码区块。

当DVD光驱读取DVD光盘片时,会对所读取的数据区块执行错误纠正。图1是一现有错误纠正系统使用内存的示意图。如图1所示,错误纠正码区块#3是一未经错误纠正处理的错误纠正码区块。错误纠正码区块#2是一正在执行错误纠正处理的错误纠正码区块。错误纠正码区块#1是一已经经过错误纠正处理的错误纠正码区块。

图2是现有错误纠正系统的时序示意图。如图2所示,在T1时,错误纠正系统由一数据信道(data channel)输入一未经错误纠正处理的错误纠正码区块(EFM#1)。在T2时,错误纠正系统由该数据信道输入一未经错误纠正处理的错误纠正码区块(EFM#2),并且对先前输入的错误纠正码区块(EFM#1)执行错误纠正处理(ECC#1)。在T3时,错误纠正系统由该数据信道输入一未经错误纠正处理的错误纠正码区块(EFM#3),并且对先前输入的错误纠正码区块(EFM#2)执行错误纠正处理(ECC#2),同时输出已经经过错误纠正处理的错误纠正码区块(DMA#1)。

然而,现有错误纠正系统输出已经经过错误纠正处理的错误纠正码区块(DMA#1)时,由于该错误纠正码区块包含该译码数据及检查字节,不仅增加内存的使用量,更增加内存传输频宽的需求,因此,现有错误纠正系统仍存有诸多的缺失,有予以改进的必要。

发明内容

本发明的一个目的在于提供一种高内存使用效率的纠错处理装置,从而减少节省内存的使用量,以减少成本。

本发明的另一目的在于提供一种高内存使用效率的纠错处理装置,从而减少内存存取频宽,而能增加系统效能。

本发明的再一目的在于提供一种高内存使用效率的纠错处理装置,从而增加内存的使用效率。

为实现上述目的,本发明提出一种高内存使用效率的纠错处理装置,包含内存、总线装置、输入缓冲器及纠错处理模块。该内存用以存储数据;该总线装置连接至该内存,以控制该内存的存取;该输入缓冲器用以接收并暂存编码区块码(block code)数据,并经由该总线装置将该编码区块码数据写入该内存中;该纠错处理模块连接至该总线装置,其经由该总线装置,以读取该内存中的该编码区块码数据,并对该编码区块码数据进行列方向译码及行方向译码,以获得译码数据及检查字节;其中,该纠错处理模块仅将该译码数据经由该总线装置而写入该内存中,且该纠错处理模块抛弃该检查字节。

为实现上述目的,本发明还提出一种高内存使用效率的纠错处理装置,包含内存、总线装置、输入缓冲器、纠错处理模块、输出直接内存存取模块。该内存用以存储数据;该总线装置连接至该内存,用以控制该内存的存取;该输入缓冲器用以接收并暂存未经错误纠正处的编码区块码数据,并经由该总线装置将该未经错误纠正处的编码区块码数据写入该内存中;该纠错处理模块连接至该总线装置,其经由该总线装置以读取该内存中的该未经错误纠正处的编码区块码数据,并对该编码区块码数据作列方向译码及行方向译码,以获得译码数据及检查字节;该输出直接内存存取模块连接至该总线装置,以经由该总线装置,而读取并输出该内存中的数据;其中,存储于该输入缓冲器中的未经错误纠正处理的该编码区块码数据被写入该内存中,并且该纠错处理模块对该编码区块码数据的主数据与前述检查字节执行错误纠正处理,以产生该编码区块码数据的前述译码数据及前述检查字节,该纠错处理模块仅将该编码区块码数据的该译码数据经由该总线装置而写入该内存中,且该纠错处理模块并抛弃该检查字节,该输出直接内存存取模块对内存中先前的该编码区块码数据的前述译码数据执行直接内存存取。本发明与现有技术相比具有以下优点,能够有效减少内存的使用量,节省内存,降低成本;减少内存存取频宽,增加系统效能;同时,本发明还可有效增加内存的使用效率。

附图说明

图1是现有错误纠正系统使用内存的示意图。

图2是现有错误纠正系统的时序示意图。

图3是本发明的高内存使用效率的纠错处理装置的方块图。

图4是本发明的内存使用示意图。

图5是本发明高内存使用效率的纠错处理装置的时序示意图。

附图标记说明

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