[发明专利]采用固件的存储器错误地址管理无效

专利信息
申请号: 200580049225.5 申请日: 2005-03-24
公开(公告)号: CN101147135A 公开(公告)日: 2008-03-19
发明(设计)人: 远藤新 申请(专利权)人: 富士通株式会社
主分类号: G06F12/16 分类号: G06F12/16
代理公司: 北京三友知识产权代理有限公司 代理人: 黄纶伟
地址: 日本神*** 国省代码: 日本;JP
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摘要:
搜索关键词: 采用 存储器 错误 地址 管理
【说明书】:

技术领域

本发明涉及一种使用了存储器控制器的信息处理装置,特别涉及与存储器的安装容量无关地进行存储器的异常监视的信息处理装置。

背景技术

近年来,伴随系统的大规模化,安装的存储器的量增加,要求较高的可靠性。迅速检测存储器的故障部位是维护大容量存储器的高度可靠性所必须的。因此,存储器的诊断和监视是必不可缺的。

图1是说明以往的存储器监视的图。在CPU3中,操作系统(OperatingSystem,以下称为OS)动作。并且,存储器2i~2l连接到CPU3上。

在以往的存储器的异常监视中,根据来自OS的指示,CPU监视存储器2i~2l内的所有存储区域。该情况时,OS对安装的存储器2i~2l内的所有区域,通过CPU3进行读出处理。不能读出的区域被诊断为错误区域,进行将其从可用区域中去除的退出处理。

OS保持OS自身退出的区域的信息,通过自身确保逻辑地址的连续性。并且,OS预先掌握存储器的安装量和硬件结构。

在这种CPU根据来自OS的指示监视所有存储区域的方法中,在存储器容量庞大的大规模系统中,其运行时的负荷过大。并且,也存在监视处理过度花费时间的问题。为了减轻CPU的负荷,可以考虑由CPU之外的硬件进行存储区域的读出的存储器监视。通过由CPU之外的硬件进行存储区域的读出和所读出数据中有无错误的确认,可以减轻CPU的负荷。

图2是CPU之外的硬件进行针对存储区域的访问的存储器监视的示例。在CPU3中,OS动作。并且,进行存储器的控制和监视的硬件即控制器C1~C3连接在CPU3上。另外,存储器2m和2n连接在控制器C1上,存储器2o和2p连接在控制器C2上,存储器2q和2r连接在控制器C3上。

控制器C1~C3在正常访问时控制对按照OS的请求连接的存储器的访问,但在存储器监视时,进行来自存储器的数据读入,在检测到错误时改变保有的寄存器的特定比特,并通知OS。

该情况时,OS也预先掌握存储器的安装量和硬件结构。并且,OS自身保持以前退出的区域的信息,通过自身确保逻辑地址的连续性。

在此,关于减轻CPU负担的硬件监视系统,有专利文献1记载的技术。该技术通过使固件进行错误的处理,抑制因错误造成的应用程序的频繁中断,减轻CPU的负担。但是,专利文献1记载的技术涉及整个硬件,不能进行存储器的监视。

专利文献1:日本特开2000-57016号公报

如图2所示,在利用CPU之外的硬件进行存储器的异常监视时,由于存储器的扩展,存储器的地址有可能被从基于以往的系统结构的地址发生变更。为了对应存储器的扩展,必须进行针对对应每个系统结构的逻辑地址的转换,但是如果使OS进行该转换,将不能利用共用的OS对应所有系统结构。并且,在通过硬件来对应系统结构的变更时,将需要对每个系统结构安装要追加的硬件,导致成本增加和开发工时增加。

发明内容

本发明的目的在于,提供一种信息处理装置,CPU不直接进行存储器的监视,即可实现利用OS和硬件之外的手段进行应对不同系统结构的存储器监视。

为了解决上述问题,根据本发明的第一侧面提供一种信息处理装置,其具有:执行OS和固件的CPU;多个存储器控制器,其连接在所述CPU上,进行针对多个存储器的写入和读出的控制及错误监视;和分别连接在所述多个存储器控制器上的所述多个存储器,该信息处理装置的特征在于,所述存储器控制器依次读入连接在该存储器控制器上的所述多个存储器的存储区域,并进行错误区域的监视,所述固件把对应于所述错误区域的所述存储器控制器所掌握的地址转换为所述OS所掌握的逻辑地址,将其提供给所述OS。

在上述发明的第一侧面中,作为优选实施例的特征在于,所述固件判断由所述存储器控制器检测出的所述错误区域是否是通过以前的读入被检测为错误区域、并被从可用区域中去除的区域,如果相应区域以前已被去除,则再次开始存储区域的读入。

在上述发明的第一侧面中,作为另一优选实施例的特征在于,所述固件进行所述错误区域的数据是否可以修复的判断,如果所述错误区域的数据可以修复,则检测到所述错误区域的所述存储器控制器再次向所述错误区域进行写入。

在上述发明的第一侧面中,作为又一优选实施例的特征在于,所述多个存储器控制器分别独立进行所述存储器的错误监视。

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