[发明专利]内存加速装置与方法以及使用其的适配卡与主板无效
| 申请号: | 01120121.5 | 申请日: | 2001-07-05 |
| 公开(公告)号: | CN1395174A | 公开(公告)日: | 2003-02-05 |
| 发明(设计)人: | 吴坤河;庄海峰 | 申请(专利权)人: | 丽台科技股份有限公司 |
| 主分类号: | G06F12/00 | 分类号: | G06F12/00;G06F1/16 |
| 代理公司: | 北京集佳专利商标事务所 | 代理人: | 王学强 |
| 地址: | 台湾省台北县*** | 国省代码: | 台湾;71 |
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| 摘要: | |||
| 搜索关键词: | 内存 加速 装置 方法 以及 使用 适配卡 主板 | ||
1.一种内存加速装置,其特征为:包括:
一内存总线加速系统装置,用来与一芯片组进行信号转换;
至少一内存总线加速装置,用来接收该内存总线加速系统装置的信号,并处理该内存总线加速系统装置与相对应的一内存之间信号转换以及存取数据的动作;以及
一内存总线,耦接该内存总线加速系统装置以及该些内存总线加速装置,
其中该内存总线加速系统装置接收该芯片组的一存取数据命令后,该内存总线加速系统装置将该存取数据命令转换成一存取命令并输出至该些内存总线加速装置,使得该些内存总线加速装置依序存取该内存总线上的数据,并与相对应的该内存做存取数据的动作。
2.如权利要求1所述的内存加速装置,其特征为:该内存总线加速系统装置,包括:
一数据功能装置,用来处理该芯片与该内存总线加速装置间的数据传递及控制;以及
一命令状态装置,耦接至该数据功能装置,用来接收该芯片组的该存取数据命令以及该内存总线加速装置的状态,并依据该存取数据命令以及该内存总线加速装置的状态,控制该数据功能装置以及该内存总线加速装置。
3.如权利要求1所述的内存加速装置,其特征为:该内存总线加速装置,包括:
一内存接口,用来处理该内存总线加速系统装置与该内存之间数据传递及控制的动作;以及
一控制内存加速装置,耦接至该内存接口,用来将该内存总线加速装置的状态传送至该内存总线加速系统装置,并接收该内存总线加速系统装置的命令,依据该内存总线加速系统装置的命令控制该内存接口。
4.如权利要求3所述的内存加速装置,其特征为:该内存接口包括:
一内存命令装置,用来接收该内存总线加速装置的命令,并依据该内存总线加速装置的命令输出一内存控制信号至该内存;以及
一内存数据装置,用来处理该内存总线加速装置与该内存之间做数据传递与控制的动作;
其中该内存接收该内存控制信号后,与该内存数据装置做数据传递与控制的动作。
5.如权利要求3所述的内存加速装置,其特征为:该控制内存加速装置,包括:
一数据功能装置,用来处理该内存总线加速系统装置与该内存接口之间的数据传递与控制的动作;以及
一命令状态装置,用来将该内存总线加速装置的状态传送至该内存总线加速系统装置,且接收该内存总线加速系统装置的命令,并依据该内存总线加速系统装置的命令控制该内存接口以及该数据功能装置。
6.一种使用内存加速装置的主板,其特征为:至少包括:
一芯片组;以及
一内存加速装置,包括:
至少一内存;
一内存总线加速系统装置,用来与该芯片组进行信号转换;
至少一内存总线加速装置,用来接收该总线加速系统装置的信号,并处理该内存总线加速系统装置与相对应的该内存之间信号转换以及存取数据的动作;以及
一内存总线,耦接该内存总线加速系统装置以及该些内存总线加速装置;
其中该内存总线加速系统装置接收该芯片组的一存取数据命令后,该内存总线加速系统装置将该存取数据命令转换成一存取命令并输出至该些内存总线加速装置,使得该些内存总线加速装置依序存取该内存总线上的数据,并与相对应的该内存做存取数据的动作。
7.如权利要求6所述的该使用内存加速装置的主板,其特征为:该内存线加速装置包括:
一加速内存模块,用来存取数据;以及
一内存总线加速插槽,耦接至该内存总线加速系统装置,用来接收该内存总线加速系统装置的信号,并处理该内存总线加速系统装置与该加速内存模块之间的信号转换及存取数据的动作。
8.如权利要求6所述的该使用内存加速装置的主板,其特征为:还包括:一外加内存,耦接至该芯片组,用来存取数据。
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