[发明专利]具有延迟补正电路的集成电路装置无效

专利信息
申请号: 96192168.4 申请日: 1996-12-27
公开(公告)号: CN1176713A 公开(公告)日: 1998-03-18
发明(设计)人: 冈安俊幸;铃木博夫 申请(专利权)人: 株式会社爱德万测试
主分类号: H03K5/14 分类号: H03K5/14
代理公司: 柳沈知识产权律师事务所 代理人: 马莹
地址: 日本*** 国省代码: 暂无信息
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摘要: 一种具有延迟误差补正电路的半导体集成电路,即使在工作中发生温度变动或电压变动,也可向传送的信号经常稳定地提供高精度的延迟时间。在所述半导体集成电路装置中,由包含需要向传送的信号提供高精度延迟时间的电路的第一半导体电路部1,和分别设于所述第一半导体电路部的前端与后端、向传送的信号提供的延迟时间的精度不高也可的两个第二半导体电路部2—1、2—2作为一个半导体集成电路而一体形成,且所述半导体集成电路装置包括驱动所述半导体集成电路的第一电源7,而且,由第一电源驱动两个第二半导体电路部的同时,还设有延迟误差补正电路,所述延迟误差补正电路包括驱动第一半导体电路部的输出电压可变的第二电源8;一体形成于需要提供所述高精度延迟时间的电路附近,用于检测在所述电路中传送的信号的延迟时间的延迟时间监控电路3;电源控制电路9,控制第二电源的输出电压,以使由所述延迟时间监控电路检测的、需要提供高精度延迟时间的电路的传送延迟时间经常成为标准延迟时间;第一及第二电平转换电路,分别插入于第一半导体电路部与前端的第二半导体电路部之间、及第一半导体电路部与后端的第二半导体电路部之间,将逻辑信号的振幅调整为分别驱动这些第一半导体电路部及第二半导体电路部的所述第二电源及第一电源的电压。
搜索关键词: 具有 延迟 补正 电路 集成电路 装置
【主权项】:
1.一种半导体集成电路装置,由包含由至少一个逻辑元件构成的、需要向传送的信号提供高精度的延迟时间的电路的第一半导体电路部,和设于所述第一半导体电路部的附近、向传送的信号提供的延迟时间的精度不高也可的第二半导体电路部,作为一个半导体集成电路而一体形成,且包括驱动所述半导体集成电路的第一电源,其特征在于,在所述半导体集成电路装置中,由所述第一电源驱动所述第二半导体电路部的同时,还具有延迟误差补正电路,所述延迟误差补正电路包括:第二电源,对包含需要提供所述高精度延迟时间的电路的第一半导体电路部进行驱动,且输出电压可变;延迟时间监控电路,一体形成于所述第一半导体电路部内的需要提供高精度延迟时间的电路附近,用于检测在所述电路中传送的信号的延迟时间;电源控制电路,控制所述第二电源的输出电压,以使由所述延迟时间监控电路检测的、需要提供所述高精度延迟时间的电路的传送延迟时间经常地成为标准延迟时间。
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