[实用新型]一种类比与数字时钟的同步化调整装置无效
| 申请号： | 93244056.8 | 申请日： | 1993-11-12 |
| 公开（公告）号： | CN2173966Y | 公开（公告）日： | 1994-08-10 |
| 发明（设计）人： | 于鸿祺 | 申请（专利权）人： | 于鸿祺 |
| 主分类号： | G04G5/00 | 分类号： | G04G5/00 |
| 代理公司： | 三友专利事务所 | 代理人： | 唐华 |
| 地址： | 台湾省台北市*** | 国省代码： | 台湾;71 |
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| 摘要： | 一种类比与数字时钟的同步化调整装置，其特征在于包括一个类比机心，一个第一集成电路，一个第二集成电路以及液晶显示器，其中，将类比机心的输出信号的部分反馈到第一与第二集成电路中，在第一集成电路中将数字信号与类比信号作比较后，输出相应的类比信号驱动步进器作出相应的动作，从而可自动校正类比与数字两系统间之误差。 | ||
| 搜索关键词： | 一种 类比 数字 时钟 同步 调整 装置 | ||
【主权项】：
1、一种类比与数字时钟的同步化调整装置，其特征在于：包括一个类比机芯，一个第一集成电路，一个第二集成电路以及液晶显示器，其中：类比机芯包括有一个步进器，一个“时”齿轮，一个“分”齿轮；步进器的输入端按集成电路(2)的输出端，步进器的输出端接“时”齿轮的驱动轴；第一集成电路(2)的信号输入端分别与机芯(1)的信号输出端及第二集成电路(3)的信号输出端相接，且将两信号互相比较后，产生类比信号，驱动步进器动作；第二集成电路(3)其输入端与机芯输出信号的反馈端相接，其输出端接第一集成电路(2)的一个信号输入端，集成电路(3)的芯片输出端(43)～(51)脚与液晶显示器(4)的输入端连接，驱动液晶显示器(4)，从而显示数字信号。
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