[其他]同步信号检测电路无效
| 申请号： | 86103308 | 申请日： | 1986-05-13 |
| 公开（公告）号： | CN86103308A | 公开（公告）日： | 1986-11-26 |
| 发明（设计）人： | 久多良木健 | 申请（专利权）人： | 索尼公司 |
| 主分类号： | G11B20/12 | 分类号： | G11B20/12;H04N5/781 |
| 代理公司： | 中国专利代理有限公司 | 代理人： | 李先春 |
| 地址： | 日本东京都品*** | 国省代码： | 暂无信息 |
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| 摘要： | 用于数字数据重现设备的同步信号检测电路，具有一个与磁头相连以导出数字信号的重现装置，一个连到重现装置以产生根据导出的数字信号的时钟信号的锁相环电路，一个同步计数器以通过计数时钟信号产生同步定时，多个与重现装置相联以检测包括在数字信号内的同步模式的同步模式检测电路和一个逻辑电路，它与多个同步模式检测电路相联，当在多个同步模式检测电路上测到数字信号的连续同步模式时，就给同步计数器提供一个初始化脉冲。 | ||
| 搜索关键词： | 同步 信号 检测 电路 | ||
【主权项】：
1、用于数字数据复制设备的同步信号检测电路，其特征为包括：a)连到一磁头并用以导出数字信号的重现装置，b)连到所述重现装置用以产生基于上述导出数字信号的时钟信号的锁相环装置，c)以通过对上述时钟信号计数而产生同步定时的同步计数装置，d)连到上述重现装置用以检测包括在上述数字信号内的同步模式的多个同步模式检测装置，和e)连到上述多个同步模式检测装置，以便在上述多个同步模式检测装置上一检测到连续同步模式就给上述同步计数装置加一个初始化脉冲的逻辑电路装置。
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