[发明专利]通过数字锁相环中的时间-数字转换器进行独立时钟控制的数字环路滤波器在审
| 申请号： | 202310293267.3 | 申请日： | 2023-03-23 |
| 公开（公告）号： | CN116805865A | 公开（公告）日： | 2023-09-26 |
| 发明（设计）人： | A·哈鲁什 | 申请（专利权）人： | 赛普拉斯半导体公司 |
| 主分类号： | H03H17/02 | 分类号： | H03H17/02;H03H17/00;H03L7/183 |
| 代理公司： | 永新专利商标代理有限公司 72002 | 代理人： | 邬少俊 |
| 地址： | 美国加利*** | 国省代码： | 暂无信息 |
| 权利要求书： | 暂无信息 | 说明书： | 暂无信息 |
| 摘要： | 一种时间‑数字转换器(TDC)电路包括相位误差计算电路，用于：基于数字锁相环(DPLL)电路的输入参考时钟和反馈时钟之间的时间差来确定相位误差值，输入参考时钟和反馈时钟是非同步的；以及将相位误差值提供给DPLL电路的数字环路滤波器(DLF)。TDC电路还包括时钟生成电路，用于：响应于检测到输入参考时钟和反馈时钟的每个最后接收到的脉冲而生成使时钟脉冲生效的滤波器时钟；以及在向DLF提供与滤波器时钟同步的相位误差值的同时，向DLF提供滤波器时钟。 | ||
| 搜索关键词： | 通过 数字 环中 时间 转换器 进行 独立 时钟 控制 环路 滤波器 | ||
【主权项】：
暂无信息
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