[发明专利]可扩展的并行卷积数据输出装置及其输出方法在审
| 申请号： | 202211720850.X | 申请日： | 2022-12-30 |
| 公开（公告）号： | CN116027977A | 公开（公告）日： | 2023-04-28 |
| 发明（设计）人： | 马向华;边立剑 | 申请（专利权）人： | 上海安路信息科技股份有限公司 |
| 主分类号： | G06F3/06 | 分类号： | G06F3/06;G06F17/15 |
| 代理公司： | 上海一平知识产权代理有限公司 31266 | 代理人： | 成春荣;竺云 |
| 地址： | 200434 上海市*** | 国省代码： | 上海;31 |
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| 摘要： | 本申请涉及人工智能相关的FPGA、ASIC技术领域，公开了一种可扩展的并行卷积数据输出装置及其输出方法，可以提高卷积运算的数据吞吐率。该装置包括：数据存储器，被配置为存储需要参加卷积的数据子块；数据读取模块，被配置为向数据存储器发送数据读取指令，从数据子块中读取大小为K*BW的数据块输出到行缓冲模块，其中，BW＝K+DN‑1，DN＝WS/DS，K为卷积核尺寸，WS为数据存储器每个地址的字长，DS为每个数据的比特数；行缓冲模块包括K行BW列的缓存和用于输出的DN个通道；行缓冲模块被配置为，将来自数据读取模块的数据写入缓存，当缓存的一行写入完成后，将该行的BW个数据通过DN个通道输出。 | ||
| 搜索关键词： | 扩展 并行 卷积 数据 输出 装置 及其 方法 | ||
【主权项】：
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