[发明专利]L2中bypass的实现方法及系统在审
| 申请号： | 202210670307.7 | 申请日： | 2022-06-14 |
| 公开（公告）号： | CN114996016A | 公开（公告）日： | 2022-09-02 |
| 发明（设计）人： | 李长林;刘磊 | 申请（专利权）人： | 广东赛昉科技有限公司 |
| 主分类号： | G06F9/50 | 分类号： | G06F9/50 |
| 代理公司： | 上海邦德专利代理事务所(普通合伙) 31312 | 代理人： | 崔双双 |
| 地址： | 528300 广东省佛山市顺德*** | 国省代码： | 广东;44 |
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| 摘要： | 本发明涉及CPU技术领域，具体涉及一种L2中bypass的实现方法及系统，包括以下步骤：初始化，load miss请求分配到core readqueue中，请求参与并赢得仲裁，上pipeline；在pipeline中miss了L2,hit wrq，直接从wrq中load数据回来；更新L2tag_ram data_ram将数据返回给core，同时deallocate掉相应的outstanding writequeue相对应的entry项。本发明直接通过bypass获得数据，不用多次上pipeline，把pipeline资源给其他的请求，大大提高了CPU的整体性能。本发明减小了L2对下一级memory的带宽需求，更早完成icache和mmu的load miss的请求，减少上pipeline的次数。 | ||
| 搜索关键词： | l2 bypass 实现 方法 系统 | ||
【主权项】：
暂无信息
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