[发明专利]具有减小的回路延迟的串行数据接口在审
| 申请号： | 202110184457.2 | 申请日： | 2021-02-10 |
| 公开（公告）号： | CN113258904A | 公开（公告）日： | 2021-08-13 |
| 发明（设计）人： | M·库马尔;K·库马尔;N·德曼吉 | 申请（专利权）人： | 意法半导体(鲁塞)公司;意法半导体国际有限公司 |
| 主分类号： | H03K3/3565 | 分类号： | H03K3/3565;G06F13/42 |
| 代理公司： | 北京市金杜律师事务所 11256 | 代理人： | 王茂华;闫昊 |
| 地址： | 法国*** | 国省代码： | 暂无信息 |
| 权利要求书： | 暂无信息 | 说明书： | 暂无信息 |
| 摘要： | 本公开的实施例涉及具有减小的回路延迟的串行数据接口。一种串行外围接口(SPI)设备包括：串行时钟(SCK)焊盘，接收串行时钟；第一施密特触发器和第二施密特触发器，直接电连接到SCK焊盘，以响应于串行时钟的上升沿和下降沿而选择性地分别生成第一时钟和第二时钟；第一触发电路和第二触发电路，由第一时钟和第二时钟进行时钟控制，以将数据比特输出到数据节点；复用器，具有耦合到数据节点上的输入和耦合到驱动电路系统上的输出；以及驱动电路系统，经由主入从出(MISO)焊盘传输数据。 | ||
| 搜索关键词： | 具有 减小 回路 延迟 串行 数据 接口 | ||
【主权项】：
暂无信息
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