[发明专利]利用划割道图案来减少缺陷的集成电路在审

专利信息
申请号: 202080074719.3 申请日: 2020-10-05
公开(公告)号: CN114600231A 公开(公告)日: 2022-06-07
发明(设计)人: A·萨利纳斯;W·K·麦克唐纳;S·A·约翰内斯梅耶尔;R·P·勒金;S·A·迈斯纳 申请(专利权)人: 德州仪器公司
主分类号: H01L21/70 分类号: H01L21/70;H01L27/02
代理公司: 北京律盟知识产权代理有限责任公司 11287 代理人: 林斯凯
地址: 美国德*** 国省代码: 暂无信息
权利要求书: 暂无信息 说明书: 暂无信息
摘要: 在实例中,一种制造集成电路的方法包括将光掩模定位于光源与半导体晶片之间,所述半导体晶片在所述晶片的晶片划割道中具有光致抗蚀剂层,其中所述光掩模包括:第一掩模划割道图案;第二掩模划割道图案,其匹配所述第一掩模划割道图案;及所述集成电路的至少一个电路图案,其位于所述第一与第二掩模划割道图案之间(802)。所述方法进一步包含照明所述光掩模以在所述晶片划割道的所述光致抗蚀剂层中产生对应于所述第二掩模划割道图案的第一经曝光部分(804);将所述第一掩模划割道图案定位于所述光源与所述第一经曝光部分之间(806);及照明所述光掩模,其中所述第一掩模划割道图案大体上屏蔽所述晶片划割道的所述光致抗蚀剂层的未曝光部分以免于曝光(808)。
搜索关键词: 利用 划割道 图案 减少 缺陷 集成电路
【主权项】:
暂无信息
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