[实用新型]延迟锁定环路有效
| 申请号: | 202021200044.6 | 申请日: | 2020-06-24 |
| 公开(公告)号: | CN214205499U | 公开(公告)日: | 2021-09-14 |
| 发明(设计)人: | M·扎姆普罗戈诺;A·塔杰法 | 申请(专利权)人: | 意法半导体股份有限公司 |
| 主分类号: | H03L7/093 | 分类号: | H03L7/093;H03L7/091 |
| 代理公司: | 北京市金杜律师事务所 11256 | 代理人: | 董莘 |
| 地址: | 意大利阿格*** | 国省代码: | 暂无信息 |
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| 摘要: | 本公开的实施例涉及延迟锁定环路。延迟锁定环路包括控制环路,其接收参考和反馈时钟信号,并根据该参考和反馈时钟信号来生成偏置电压。延迟链接收参考时钟信号,并生成参考时钟信号的N个连续延迟版本,其各自在延迟链的连续抽头处。第N延迟版本是反馈时钟信号。控制环路具有相位检测器,当反馈时钟信号的相位滞后于参考时钟信号的相位时,相位检测器断言上信号,而当反馈时钟信号的相位超前于参考时钟信号的相位时,相位检测器断言下信号。数字滤波块将参考时钟信号周期期间的上信号的断言的数目与下信号的断言的数目相比较,并据此断言上或下命令信号。偏置电压生成电路接收上和下命令信号,并据此生成偏置电压。 | ||
| 搜索关键词: | 延迟 锁定 环路 | ||
【主权项】:
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