[发明专利]一种基于忆阻器的混合逻辑乘累加电路在审
| 申请号： | 202011319992.6 | 申请日： | 2020-11-23 |
| 公开（公告）号： | CN114527957A | 公开（公告）日： | 2022-05-24 |
| 发明（设计）人： | 孙文浩;吴启樵;陈松 | 申请（专利权）人： | 中国科学技术大学 |
| 主分类号： | G06F7/544 | 分类号： | G06F7/544 |
| 代理公司： | 北京科迪生专利代理有限责任公司 11251 | 代理人： | 张乾桢 |
| 地址： | 230026 安*** | 国省代码： | 安徽;34 |
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| 摘要： | 本发明公开了一种基于忆阻器的混合逻辑乘累加电路，该电路包括数据缓存器，忆阻器阵列，移位器，加法器，寄存器；输入数据通过数据缓存器输入，所述数据缓存器连接到忆阻器阵列，将缓存数据输入至忆阻器阵列中；忆阻器阵列的输出连接到移位器，移位器连接有时钟信号以及多个加法器，移位器移位之后的结果输入到加法器，通过加法器与寄存器的原数据相加，将结果重新存入寄存器中。本发明通过忆阻器和CMOS电路的结合，既实现了数据存储，又完成了逻辑运算；结合本发明上述电路，不仅可以减少面积，还能降低功耗并实现存算一体化。 | ||
| 搜索关键词： | 一种 基于 忆阻器 混合 逻辑 累加 电路 | ||
【主权项】：
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