[发明专利]积和运算器、神经形态器件以及积和运算器的使用方法有效
| 申请号： | 201980005310.3 | 申请日： | 2019-02-27 |
| 公开（公告）号： | CN111279351B | 公开（公告）日： | 2023-08-25 |
| 发明（设计）人： | 柴田龙雄;佐佐木智生 | 申请（专利权）人： | TDK株式会社 |
| 主分类号： | G06G7/60 | 分类号： | G06G7/60;G06N3/063;H01L29/82;H01L27/04;H10B99/00;H01L21/822;H01L27/105 |
| 代理公司： | 北京尚诚知识产权代理有限公司 11322 | 代理人： | 杨琦;徐飞跃 |
| 地址： | 日本*** | 国省代码： | 暂无信息 |
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| 摘要： | 本发明提供一种积和运算器(1)，其包括积运算部(10)以及和运算部(11)，所述积运算部(10)包括作为电阻变化元件的多个积运算元件(10AA、10AB)和至少一个参考元件(10AMAX、10AMIN)，所述和运算部(11)至少包括检测来自所述多个积运算元件的输出的合计值的输出检测器(11A)，所述多个积运算元件各自为磁阻效应元件，包括：具有磁壁的磁化自由层；磁化方向被固定的磁化固定层；和由所述磁化自由层与所述磁化固定层夹持的非磁性层，所述参考元件为包括不具有磁壁的磁化自由层的参考磁阻效应元件。 | ||
| 搜索关键词： | 运算器 神经 形态 器件 以及 使用方法 | ||
【主权项】：
暂无信息
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