[发明专利]增强抗扰性锁存的逻辑状态保留在审
| 申请号： | 201911372722.9 | 申请日： | 2019-12-27 |
| 公开（公告）号： | CN111384941A | 公开（公告）日： | 2020-07-07 |
| 发明（设计）人： | S·普鲁索塔曼;S·P·黛博纳;P·T·罗伊内;S·C·巴特林;K·B·钦塔马尼 | 申请（专利权）人： | 德克萨斯仪器股份有限公司 |
| 主分类号： | H03K19/003 | 分类号： | H03K19/003 |
| 代理公司： | 北京纪凯知识产权代理有限公司 11245 | 代理人： | 赵志刚 |
| 地址： | 美国德*** | 国省代码： | 暂无信息 |
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| 摘要： | 本申请公开了增强抗扰性锁存的逻辑状态保留。在描述的示例中，锁存器(参见260)包括用于锁存输入信息的电路(参见220)。电路可响应于第一模式的指示被预充电(参见210)，并且可将输入信息锁存至第二模式的指示(参见210)。锁存器可以可选地还响应于用于存储所锁存的输入信息的节点(参见290、292)来锁存输入信息。 | ||
| 搜索关键词： | 增强 抗扰性锁存 逻辑 状态 保留 | ||
【主权项】：
暂无信息
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