[发明专利]加速器时序及快速机器保护一体化系统的主逻辑插件有效
| 申请号： | 201911258538.1 | 申请日： | 2019-12-10 |
| 公开（公告）号： | CN111103828B | 公开（公告）日： | 2021-07-06 |
| 发明（设计）人： | 朱鹏;金大鹏;张玉亮;康明涛;何泳成;吴煊;郭凤琴;王林 | 申请（专利权）人： | 散裂中子源科学中心;中国科学院高能物理研究所 |
| 主分类号： | G05B19/042 | 分类号： | G05B19/042;H05H7/00 |
| 代理公司： | 广东勤诺律师事务所 44595 | 代理人： | 张雪华 |
| 地址： | 523000 广东省东莞市松山湖高新技术产业开发区总部*** | 国省代码： | 广东;44 |
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| 摘要： | 本发明涉及加速器领域，尤指一种使得该一体化系统能够同时满足加速器物理对时序系统和快速机器保护系统的一种加速器时序及快速机器保护一体化系统的主逻辑插件；所述的一体化系统架构的主要硬件包括VME机箱、VME控制器、VME J2背板连接插件、主逻辑插件和多功能接口插件，所述的主逻辑插件采用标准6U VME插件尺寸，并采用Xilinx公司生产的XC6SLX100T‑2FGG900C为Xilinx FPGA逻辑芯片，该逻辑芯片附有可编程逻辑资源，将本主逻辑插件集成一种基于低成本、高灵活性强的时序及快速保护系统一体化架构并付之实践，能够可靠稳定地进行信号输入/输出等高效交互，一体化实现了快速逻辑处理和时序设计功能等，达到满足加速器物理对时序系统和快速机器保护系统需求。 | ||
| 搜索关键词： | 加速器 时序 快速 机器 保护 一体化 系统 逻辑 插件 | ||
【主权项】：
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